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一种改进的RS-Polar码级联译码方案及硬件实现

摘要第3-4页
abstract第4页
第1章 绪论第8-12页
    1.1 数字通信系统与差错控制编码第8-9页
    1.2 Polar码和级联码的发展第9-10页
    1.3 本文结构及内容安排第10-12页
第2章 Polar码理论基础第12-24页
    2.1 Polar码基本概念第12-13页
    2.2 Polar码极化原理第13-16页
        2.2.1 信道组合第13-15页
        2.2.2 信道分离第15页
        2.2.3 信道极化第15-16页
    2.3 Polar码编码第16-19页
        2.3.1 信息集选取第16-18页
        2.3.2 构造生成矩阵第18-19页
    2.4 Polar码译码第19-24页
        2.4.1 SC译码算法第19-20页
        2.4.2 SCL译码算法第20-24页
第3章 基于RS码的级联Polar码第24-34页
    3.1 级联码的概念第24-25页
        3.1.1 单级级联码第24-25页
        3.1.2 多级级联码第25页
    3.2 RS码简介第25-32页
        3.2.1 RS码编码第26-27页
        3.2.2 RS码译码第27-28页
        3.2.3 HDD-LCC译码算法第28-32页
    3.3 RS-Polar级联码第32-34页
        3.3.1 RS-Polar级联方案第32页
        3.3.2 RS-Polar级联码编码第32-33页
        3.3.3 RS-Polar级联码译码第33-34页
第4章 基于阈值的RS-Polar码级联译码方案第34-42页
    4.1 基于阈值的RS-Polar码级联译码算法第34-37页
        4.1.1 阈值设定第34-35页
        4.1.2 用于级联的MA模块第35-36页
        4.1.3 基于阈值的SCL-HDDLCC级联译码算法第36-37页
    4.2 基于阈值的RS-Polar级联方案仿真结果及分析第37-42页
        4.2.1 译码复杂度分析第37页
        4.2.2 译码时延分析第37-38页
        4.2.3 译码性能仿真结果分析第38-42页
第5章 基于阈值的RS-Polar级联译码器硬件架构设计第42-64页
    5.1 RS-Polar级联译码器整体架构第42-43页
    5.2 Polar码SCL译码器架构设计第43-49页
        5.2.1 SC译码器第44-47页
        5.2.2 度量计算模块第47-48页
        5.2.3 度量比较模块第48-49页
        5.2.4 控制信号及译码比特生成模块第49页
    5.3 RS码HDD-LCC译码器架构设计第49-59页
        5.3.1 有限域下基本单元模块第50-52页
        5.3.2 校验子计算模块第52-53页
        5.3.3 校验子更新模块第53-54页
        5.3.4 关键方程求解模块第54-56页
        5.3.5 钱搜索和多项式选择模块第56-58页
        5.3.6 福尼算法模块第58页
        5.3.7 HDD-LCC译码器延时分析第58-59页
    5.4 RS-Polar级联译码器结果分析第59-64页
        5.4.1 逻辑综合第59-60页
        5.4.2 静态时序分析第60-62页
        5.4.3 功耗分析第62-64页
第6章 总结与展望第64-66页
    6.1 总结第64-65页
    6.2 展望第65-66页
参考文献第66-70页
发表论文和参加科研情况说明第70-72页
致谢第72页

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