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高速低功耗二分频器与三模预分频器的设计

摘要第4-5页
Abstract第5页
缩略语表第14-15页
第1章 绪论第15-21页
    1.1 课题背景与意义第15-16页
        1.1.1 课题背景第15-16页
        1.1.2 课题意义第16页
    1.2 国内外研究现状第16-18页
    1.3 研究内容与设计指标第18页
        1.3.1 研究内容第18页
        1.3.2 设计指标第18页
    1.4 论文组织第18-21页
第2章 镜像抑制接收机中频率综合器的基本理论与结构设计第21-43页
    2.1 镜像频率第21页
    2.2 镜像抑制第21-23页
        2.2.1 镜像抑制滤波器第22页
        2.2.2 零中频接收机第22-23页
        2.2.3 低中频接收机第23页
    2.3 正交(I/Q)信号的产生第23-25页
        2.3.1 RC-CR网络第23-24页
        2.3.2 分频器第24页
        2.3.3 正交LC振荡器第24-25页
    2.4 锁相环型频率综合器第25-26页
        2.4.1 基本工作原理第25-26页
        2.4.2 整数频率综合器与分数频率综合器的区别第26页
    2.5 分数频率综合器的基本结构第26-33页
        2.5.1 鉴频鉴相器和电荷泵第27页
        2.5.2 环路滤波器第27-28页
        2.5.3 压控振荡器第28-30页
        2.5.4 整数分频器第30-31页
        2.5.5 Δ-Σ调制器第31-33页
    2.6 分数频率综合器的理论模型第33-40页
        2.6.1 线性小信号模型第33-34页
        2.6.2 相位噪声模型第34-37页
        2.6.3 毛刺第37-39页
        2.6.4 锁定时间第39页
        2.6.5 输出频率范围第39页
        2.6.6 频率分辨率第39-40页
    2.7 本课题分数频率综合器的系统结构第40页
    2.8 本章小结第40-43页
第3章 正交二分频器的设计与仿真分析第43-63页
    3.1 正交二分频器的原理分析第43-45页
        3.1.1 D锁存器第43-44页
        3.1.2 主从锁存器第44页
        3.1.3 主从锁存器的稳定性第44-45页
    3.2 正交二分频器的结构选取第45-50页
        3.2.1 传输门主从锁存器第46页
        3.2.2 时钟控制CMOS主从锁存器第46-47页
        3.2.3 共源共栅电压切换逻辑主从锁存器第47-48页
        3.2.4 真单相时钟主从锁存器第48-49页
        3.2.5 电流模型主从锁存器第49-50页
    3.3 正交二分频器的电路设计第50-53页
        3.3.1 基本差动放大器第50-51页
        3.3.2 低功耗正交二分频器电路第51-52页
        3.3.3 缓冲级第52-53页
    3.4 正交二分频器的前仿真验证第53-55页
        3.4.1 正交二分频器的功能仿真第53-54页
        3.4.2 正交二分频器的相位误差仿真第54-55页
    3.5 正交二分频器的版图设计第55-60页
        3.5.1 工艺规则第56页
        3.5.2 器件匹配第56-57页
        3.5.3 浅沟槽隔离应力效应第57-59页
        3.5.4 闩锁效应与保护环第59页
        3.5.5 版图设计第59-60页
    3.6 正交二分频器的后仿真验证第60-61页
    3.7 本章小结第61-63页
第4章 16/16.5/17三模预分频器的设计与仿真分析第63-85页
    4.1 双模预分频器第63-69页
        4.1.1 工作原理第63-64页
        4.1.2 最小连续分频比第64-65页
        4.1.3 N/N+0.5双模预分频器第65-66页
        4.1.4 基于动态电路技术的双模预分频器第66-68页
        4.1.5 基于相位切换技术的双模预分频器第68-69页
    4.2 三模预分频器第69-73页
        4.2.1 最小连续分频比第69-70页
        4.2.2 基于相位切换技术的三模预分频器第70-73页
    4.3 16/16.5/17三模预分频器的电路设计第73-78页
        4.3.1 整体结构第73-76页
        4.3.2 相位切换电路第76页
        4.3.3 相位控制电路第76-78页
    4.4 16/16.5/17三模预分频器的前仿真验证第78-81页
    4.5 16/16.5/17三模预分频器的版图设计第81-82页
    4.6 16/16.5/17三模预分频器的后仿真验证第82-83页
    4.7 本章小结第83-85页
第5章 总结与展望第85-87页
参考文献第87-91页
致谢第91页

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