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基于JPEG算法的数字图像压缩技术应用研究

中文摘要第4-5页
Abstract第5-6页
目录第7-10页
第1章 绪论第10-16页
    1.1 课题研究背景及意义第10-12页
    1.2 国内外同类课题研究现状及发展趋势第12-13页
    1.3 论文研究的主要内容与结构安排第13-16页
第2章 数字图像压缩技术的基本理论第16-24页
    2.1 数据压缩的必要性第16-17页
        2.1.1 压缩的条件第16页
        2.1.2 数据冗余第16-17页
    2.2 图像压缩的分类及其基本编码方式第17-19页
        2.2.1 无损压缩技术第17-18页
        2.2.2 有损压缩技术第18-19页
    2.3 典型图像压缩算法的比较第19-23页
    2.4 本章小结第23-24页
第3章 JPEG 编码算法研究第24-48页
    3.1 JPEG 算法简介第24页
    3.2 JPEG 算法基本原理第24-35页
        3.2.1 JPEG 编码器第24-30页
        3.2.2 JPEG 解码器第30-35页
    3.3 JPEG 编码流程分析第35-43页
        3.3.1 YUV 色彩空间转换第35-37页
        3.3.2 离散余弦变换(DCT 和 IDCT)第37-38页
        3.3.3 量化第38-40页
        3.3.4 熵编码第40-43页
    3.4 JPEG 算法仿真与实现第43-47页
    3.5 本章小结第47-48页
第4章 信息论与纠错编码第48-69页
    4.1 信息论基础第48页
    4.2 卷积码概述第48-49页
    4.3 卷积码结构特性及维特比译码第49-56页
        4.3.1 卷积码的状态图和网格描述第49-51页
        4.3.2 卷积码的传递函数第51-54页
        4.3.3 维特比算法第54-56页
    4.4 卷积码的 Matlab 仿真实现第56-64页
        4.4.1 (2,1,7)卷积码编码器第56-58页
        4.4.2 (2,1,7)编码器的 Matlab 仿真第58-59页
        4.4.3 维特比译码原理分析与 Matlab 仿真第59-60页
        4.4.4 基于 Matlab 的 (2,1,7)卷积码性能分析第60-63页
        4.4.5 DSP 实现的(2,1,7)卷积码性能仿真第63-64页
    4.5 卷积码的硬件平台实现第64-68页
        4.5.1 卷积码编码的 DSP 实现第64-65页
        4.5.2 维特比译码的 DSP 实现第65-66页
        4.5.3 卷积码的纠错能力验证第66-68页
    4.6 本章小结第68-69页
第5章 SDR 系统信源模块的硬件系统搭建与实现第69-93页
    5.1 SDR 模块硬件平台第69-72页
        5.1.1 SDR 系统的功能结构第69-70页
        5.1.2 SDR 系统的硬件结构第70-71页
        5.1.3 DSP 芯片介绍第71-72页
    5.2 信源硬件电路设计第72-79页
        5.2.1 视频解码器电路设计第72-73页
        5.2.2 外部存储器电路设计第73-74页
        5.2.3 外部缓存器电路设计第74-75页
        5.2.4 信源电源电路设计第75-77页
        5.2.5 信源与信道模块复接接口电路第77页
        5.2.6 信源模块 EMIF 总线接口电路第77-78页
        5.2.7 自启动电路设计第78-79页
    5.3 PCB 结构设计第79-81页
    5.4 JPEG 算法的 DSP 实现第81-84页
        5.4.1 集成开发环境 CCS 简介第81-82页
        5.4.2 DSP 软件开发流程第82-84页
    5.5 实验结果测试第84-91页
    5.6 本章小结第91-93页
结论第93-94页
参考文献第94-100页
致谢第100-101页
攻读硕士学位期间发表的学术论文与奖励第101-102页
攻读硕士学位期间参加的科研项目第102页

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