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基于FPGA的机载视频图形显示系统硬件设计与实现

摘要第4-5页
Abstract第5页
缩略词注释表第12-13页
第一章 绪论第13-18页
    1.1 研究背景及意义第13页
    1.2 研究现状与问题第13-16页
        1.2.1 国内外研究现状第13-16页
        1.2.2 研究难点第16页
    1.3 性能指标与研究内容第16-18页
        1.3.1 主要性能指标第16-17页
        1.3.2 主要研究内容第17-18页
第二章 系统核心器件选择第18-23页
    2.1 引言第18页
    2.2 Kintex 7 FPGA简介第18-19页
    2.3 FPGA结构及其工作原理第19-20页
    2.4 存储器选择第20-22页
        2.4.1 DDR3 SDRAM第20-21页
        2.4.2 SRAM第21页
        2.4.3 FLASH第21-22页
    2.5 本章小结第22-23页
第三章 系统硬件平台设计第23-39页
    3.1 硬件平台概述第23页
    3.2 硬件平台架构设计第23页
    3.3 FPGA的I/O资源分配第23-25页
    3.4 视频编解码模块设计第25-30页
        3.4.1 PAL视频解码模块第25-26页
        3.4.2 DVI视频解码模块第26-28页
        3.4.3 DVI视频编码模块第28-30页
    3.5 高速存储接口设计第30-33页
        3.5.1 DDR3存储接口设计第30-31页
        3.5.2 SRAM存储接口设计第31-33页
    3.6 FLASH存储接口设计第33-34页
    3.7 IIC总线设计第34-36页
    3.8 监控与调试模块设计第36-38页
        3.8.1 系统监控模块设计第36页
        3.8.2 RS485通信接口设计第36-38页
    3.9 FPGA启动配置设计第38页
    3.10 本章小结第38-39页
第四章 系统功耗分析与外围电路设计第39-55页
    4.1 引言第39页
    4.2 系统功耗分析第39-43页
        4.2.1 FPGA功耗分析第39-41页
        4.2.2 DDR3功耗分析第41-43页
        4.2.3 系统总体功耗分析第43页
    4.3 电源方案设计第43-50页
        4.3.1 电源分配网络设计第43-45页
        4.3.2 电源电路设计第45-49页
        4.3.3 系统电源上电时序分析第49-50页
    4.4 时钟分配网络设计第50-52页
        4.4.1 时钟分配方案第50-51页
        4.4.2 基于IDT5V9885的时钟分发模块设计第51-52页
    4.5 PCI桥接模块设计第52-54页
    4.6 PCI-E高速接口设计第54页
    4.7 本章小结第54-55页
第五章 DDR3高速存储接口信号完整性仿真分析第55-63页
    5.1 总体设计第55-56页
    5.2 仿真前的准备工作第56-58页
        5.2.1 FPGA芯片管脚分配第56-58页
        5.2.2 Hyperlynx仿真设置第58页
    5.3 DDR3高速存储接口信号完整性仿真结果第58-62页
        5.3.1 数据总线的仿真分析第58-60页
        5.3.2 地址及控制总线的仿真分析第60-61页
        5.3.3 时钟信号线的仿真分析第61-62页
    5.4 仿真结果分析第62页
    5.5 本章小结第62-63页
第六章 系统测试与结果分析第63-73页
    6.1 引言第63-64页
    6.2 电源模块调试第64-66页
    6.3 时钟模块调试第66-68页
    6.4 热成像测试分析第68-70页
    6.5 问题及解决办法第70页
    6.6 软硬件联合调试第70-72页
    6.7 本章小结第72-73页
第七章 结束语第73-75页
    7.1 总结第73页
    7.2 展望第73-75页
参考文献第75-78页
致谢第78-79页
在学期间的研究成果及发表的学术论文第79页

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