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H.264/AVC编码器ESL系统级设计

摘要第1-4页
 ABSTRACT第4-13页
1 绪论第13-16页
   ·背景第13-14页
   ·H.264/AVC 编码器系统级设计的研究意义和内容第14-15页
     ·本课题的研究意义第14-15页
     ·本课题研究内容第15页
   ·本文的篇章结构第15页
   ·本章小结第15-16页
2 电子系统级设计方法第16-22页
   ·背景和历史第16-17页
   ·为什么需要ESL第17-19页
   ·SystemC 语言简介第19-20页
   ·ESL 设计方法第20-21页
   ·本章小结第21-22页
3 H.264/AVC 标准简介第22-42页
   ·综述第22-25页
     ·NAL 层第22-23页
     ·VCL 层第23-24页
     ·多帧预测技术第24页
     ·整数DCT 变换第24-25页
     ·运动矢量的进一步精确第25页
     ·熵编码第25页
     ·环路滤波第25页
     ·非均匀量化第25页
   ·帧内预测原理第25-33页
     ·4×4 亮度块的9 种预测模式第25-32页
     ·16×16 亮度块的4 种预测模式第32-33页
     ·8×8 色度块的4 种预测模式第33页
   ·帧间预测第33-41页
     ·H.264/AVC 中的帧间预测第33-34页
     ·P slice 的帧间预测第34-36页
     ·B slice 的帧间预测第36-37页
     ·提高的运动补偿精度第37-41页
   ·本章小结第41-42页
4 H.264/AVC 编码器编码速度瓶颈分析第42-49页
   ·H.264 三大开源编码器比较第42-43页
   ·关键函数分析第43-44页
   ·编码器功能模块运行时间分析第44-48页
   ·本章小结第48-49页
5 H.264/AVC 系统级加速的解决方案第49-66页
   ·编码器并行化设计的现状第49-50页
   ·系统优化方案分析第50-51页
   ·新参考帧选取方法标准性的分析和实验第51-52页
     ·新参考帧选取方法的标准性第51页
     ·C 代码级验证第51-52页
   ·ARM+COPRO~n 的系统设计和性能分析第52-65页
     ·系统的可扩展性分析第52-53页
     ·理想架构设计第53-55页
     ·ESL 平台设计流程第55-56页
     ·ARM 和协处理器之间的控制流程设计第56-59页
     ·中断服务流程设计第59-60页
     ·各核ROM 空间的配置第60-62页
     ·中断控制模块的建模设计第62-65页
   ·本章小结第65-66页
6 系统控制接口的验证和并行编码性能分析第66-84页
   ·ARM 和协处理器接口设计的验证第66-69页
   ·并行编码性能分析和比较第69-82页
     ·并行编码的过程和测试条件第70-72页
     ·编码一帧图像平均所需时间的测试第72-74页
     ·交互数据传输时间的估算第74-76页
     ·ARM 读取一帧数据过程所需时间测试第76-78页
     ·启动协处理器过程所需时间测试第78-79页
     ·打开Cache 的加速分析第79-80页
     ·实验值和理论分析值的比较第80-82页
   ·架构中存在的问题第82-83页
     ·数据总线竞争问题第82-83页
     ·数据共享问题第83页
   ·本章小结第83-84页
7 总结和展望第84-87页
   ·总结第84页
   ·后续的工作第84-85页
   ·展望第85-87页
参考文献第87-90页
附录1 中断控制模块核心代码第90-92页
附录2 H.264/AVC 编码器开源软件代码架构第92-95页
附录3 Carphone.yuv 视频在 H.264/AVC 编码器上的复杂度分析报告(部分函数)第95-98页
附录4 h->frames 参数的数据结构第98-100页
致谢第100-101页
攻读学位期间发表的学术论文第101-103页

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