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16位100 MS/s无采保流水线ADC的研究与设计

摘要第5-6页
ABSTRACT第6-7页
第一章 绪论第11-15页
    1.1 研究背景及意义第11-12页
    1.2 国内外研究现状第12-14页
        1.2.1 国外研究现状第12-13页
        1.2.2 国内研究现状第13-14页
    1.3 本文的主要工作及论文结构第14-15页
第二章 ADC的基本理论以及流水线ADC的工作原理第15-27页
    2.1 ADC简介第15-16页
    2.2 数模转换器的主要性能参数第16-19页
        2.2.1 分辨率(resolution)第16页
        2.2.2 失调误差和增益误差第16-17页
        2.2.3 积分非线性(INL)第17页
        2.2.4 微分非线性(DNL)第17页
        2.2.5 信噪比(SNR)第17-18页
        2.2.6 信号噪声失真比(SNDR)第18页
        2.2.7 无杂散动态范围(SFDR)第18页
        2.2.8 有效位数(ENOB)第18-19页
    2.3 流水线ADC的基本结构及工作原理第19-20页
    2.4 流水线ADC的关键单元电路分析第20-26页
        2.4.1 采样保持电路第20-21页
        2.4.2 流水线子转换级电路第21-23页
        2.4.3 时钟产生电路第23-24页
        2.4.4 冗余位校正第24-26页
    2.5 本章小结第26-27页
第三章 16位 100 MS/s无采保流水线ADC的系统设计第27-40页
    3.1 流水线ADC的非理性因素第27-31页
        3.1.1 电容失配第27-28页
        3.1.2 运放的非理想因素第28-31页
            3.1.2.1 运放的有限直流增益第28-29页
            3.1.2.2 运放的有限单位增益带宽第29-31页
            3.1.2.3 运放的摆率第31页
    3.2 无采保结构的确定第31-32页
    3.3 首级MDAC的有效精度第32-34页
    3.4 最后一级Flash ADC的精度第34-35页
    3.5 中间级的精度分配第35-39页
    3.6 本章小结第39-40页
第四章 主要关键技术和电路的设计第40-55页
    4.1 16位 100 MS/s无采保流水线ADC的主要关键技术第40-48页
        4.1.1 首级 3.5 位MDAC的关键技术第40-43页
        4.1.2 第二级 1.5 位MDAC的关键技术第43-45页
        4.1.3 数字校正技术第45-48页
    4.2 关键单元电路的设计第48-54页
        4.2.1 MDAC电路的设计第48-53页
            4.2.1.1 残差放大器的设计第48-52页
            4.2.1.2 栅压自举开关的设计第52-53页
        4.2.2 比较器电路的设计第53-54页
    4.3 本章小结第54-55页
第五章 电路版图设计与仿真结果第55-67页
    5.1 版图设计技术第55-57页
        5.1.1 叉指晶体管第55-56页
        5.1.2 对称性与匹配第56页
        5.1.3 串扰考虑第56-57页
    5.2 16位 100 MS/s无采保流水线ADC的版图实现第57-61页
        5.2.1 系统布局第57页
        5.2.2 栅压自举开关的版图实现第57-58页
        5.2.3 Flash ADC的版图实现第58-59页
        5.2.4 MDAC的版图实现第59-60页
        5.2.5 整体ADC的版图实现第60-61页
    5.3 仿真结果及分析第61-66页
        5.3.1 运放的仿真结果第61-62页
        5.3.2 栅压自举开关的仿真结果第62-63页
        5.3.3 MDAC的仿真结果第63-64页
        5.3.4 整体ADC的仿真结果第64-66页
    5.4 本章小结第66-67页
第六章 结论第67-69页
    6.1 本文的主要工作和贡献第67-68页
    6.2 后续工作展望第68-69页
致谢第69-70页
参考文献第70-73页
攻读硕士学位期间取得的成果第73-74页

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