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SDH分/插复用器ADM的设计与实现

摘要第1-9页
ABSTRACT第9-10页
绪论第10页
行业发展趋势第10-13页
 选题背景第10-11页
 课题提出第11-12页
 课题的研究意义第12页
 论文内容安排第12-13页
第一章 同步数字体系(SDH)综述第13-19页
   ·PDH技术及其局限性第13页
   ·SDH的优势第13-15页
   ·STM-N的帧结构第15页
   ·SDH的复用原理第15-17页
   ·SDH网络常见网元第17-19页
第二章 STM-1分/插复用器ADM总体设计方案第19-27页
   ·FPGA设计流程第19-20页
     ·电路设计与输入第19页
     ·功能仿真第19页
     ·综合优化第19-20页
     ·实现第20页
     ·时序仿真第20页
     ·调试与加载配置第20页
   ·Spartan-3代系列FPGA通用总体设计流程第20-21页
   ·设计流程中重点使用的FPGA工具第21-22页
     ·综合工具Synplify第21页
     ·仿真工具ModelSim第21-22页
     ·集成软件环境ISE第22页
   ·约束输入、下载配置和板级调试第22-24页
     ·约束输入第22-23页
     ·辅助设计工具第23页
     ·下载配置第23页
     ·板级调试第23-24页
   ·ADM系统结构图第24页
   ·E1/STM-1复用器系统的设计思想第24-25页
   ·STM-1/E1解复用器系统的设计思想第25-27页
第三章 E1/STM-1复用器系统的设计与FPGA验证第27-50页
   ·模块设计第27-36页
     ·码型转换模块第28-29页
     ·时钟及时钟使能产生模块第29页
     ·码速调整和VC-12成帧模块第29-34页
     ·串并转换和TU-12成帧模块第34页
     ·VC-4高阶通道开销产生模块第34-35页
     ·VC-4成帧模块第35-36页
   ·功能仿真第36页
   ·综合与实现第36-38页
     ·综合报告第37-38页
     ·实现第38页
   ·时序仿真第38-49页
     ·时钟及时钟使能产生模块的时序仿真第39-41页
     ·码速调整和VC-12成帧模块的时序仿真第41-44页
     ·串并转换和TU-12成帧模块的时序仿真第44-46页
     ·高阶通道开销产生和VC-4成帧模块的时序仿真第46-49页
   ·VC-4/STM-1复用器原理第49页
   ·本章小结第49-50页
第四章 STM-1/E1解复用器系统的设计与FPGA验证第50-74页
   ·模块设计第50-62页
     ·并行帧同步码组检测模块第50-53页
     ·并行解扰模块第53-55页
     ·指针解释&恢复模块第55-58页
     ·VC-4抽取解复用模块第58-59页
     ·TU-12支路抽取解复用模块第59-60页
     ·误码校验模块第60-62页
   ·功能仿真第62-68页
     ·并行帧同步码组检测模块的功能仿真第63页
     ·并行解扰模块的功能仿真第63页
     ·指针解释&恢复模块的功能仿真第63-64页
     ·VC-4抽取解复用模块的功能仿真第64-66页
     ·TU-12支路抽取解复用模块的功能仿真第66-67页
     ·误码校验模块模块的功能仿真第67-68页
   ·综合与实现第68-69页
     ·综合报告第68-69页
     ·实现第69页
   ·时序仿真第69-72页
     ·并行帧同步码组检测模块的时序仿真第69-70页
     ·并行解扰模块的时序仿真第70页
     ·VC-4抽取解复用模块的时序仿真第70页
     ·TU-12支路抽取解复用模块的时序仿真第70-71页
     ·误码校验模块的时序仿真第71-72页
   ·TU-12/E1解复用器原理第72-73页
   ·本章小结第73-74页
结束语第74-75页
参考文献第75-79页
致谢第79-80页
攻读学位期间发表的学术论文第80-81页
学位论文评阅及答辩情况表第81页

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