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高性能一体化空间综合电子技术研究

摘要第4-6页
abstract第6-8页
第1章 绪论第17-29页
    1.1 研究背景第17页
    1.2 研究意义第17-18页
    1.3 国内外研究现状和发展趋势第18-25页
        1.3.1 国外研究现状和发展趋势第18-22页
        1.3.2 国内研究现状和发展趋势第22-24页
        1.3.3 存在的问题和差距第24-25页
    1.4 论文研究内容与创新点第25-27页
        1.4.1 研究内容第25-26页
        1.4.2 论文创新点第26-27页
    1.5 论文组织结构第27-29页
第2章 综合电子系统架构模型分析与设计第29-43页
    2.1 星载电子设备互连架构第29-33页
    2.2 星载计算机内部架构第33-42页
        2.2.1 关于开放式系统和标准化第34-35页
        2.2.2 架构模型第35-36页
        2.2.3 架构设计第36-42页
    2.3 本章小结第42-43页
第3章 星载计算机设计与实现第43-81页
    3.1 总体设计第43-44页
    3.2 功能单元设计第44-63页
        3.2.1 计算机单元第44-53页
        3.2.2 复接存储单元第53-56页
        3.2.3 存储扩展单元第56-58页
        3.2.4 低速接口单元第58-61页
        3.2.5 背板单元第61-62页
        3.2.6 电源单元第62-63页
    3.3 FPGA配置/刷新和重构第63-73页
        3.3.1 SRAM型 FPGA配置/刷新第64-67页
        3.3.2 FLASH型 FPGA重构第67-73页
    3.4 时分复用低速IO控制接口第73-75页
    3.5 FPGA模块化和标准化第75-79页
        3.5.1 目的和原则第75-76页
        3.5.2 APB总线介绍第76-79页
        3.5.3 计算机控制FPGA的模块化设计第79页
    3.6 本章小结第79-81页
第4章 高速串行接口设计与仿真第81-131页
    4.1 高速串行总线介绍第81-93页
        4.1.1 常用的高速串行总线第81-82页
        4.1.2 SmartFusion2 FPGA高速串行接口第82-93页
    4.2 高速串行接口设计第93-102页
        4.2.1 使用LiteFast协议的接口设计第94-100页
        4.2.2 使用自定义协议的接口设计第100-102页
    4.3 仿真第102-130页
        4.3.1 高速串行接口FPGA设计仿真第102-117页
        4.3.2 高速串行链路信号完整性仿真第117-130页
    4.4 本章小结第130-131页
第5章 高速复接和大容量存储关键技术研究第131-139页
    5.1 高速复接第131-135页
        5.1.1 AOS业务类型和实现方式第131-132页
        5.1.2 本文的业务类型和实现方式第132-135页
    5.2 大容量存储第135-138页
    5.3 本章小结第138-139页
第6章 星上链路协议研究第139-151页
    6.1 协议架构第139-145页
    6.2 协议设计第145-149页
        6.2.1 传输层协议第145-147页
        6.2.2 应用层协议第147-149页
    6.3 本章小结第149-151页
第7章 测试与验证第151-161页
    7.1 高速串行接口验证第151-156页
        7.1.1 SerDes模块初始化第152-154页
        7.1.2 SerDes接口调试第154-156页
    7.2 高速存储验证第156-159页
    7.3 FLASH型 FPGA重构验证第159页
    7.4 本章小结第159-161页
第8章 总结与展望第161-167页
    8.1 总结第161-164页
    8.2 下一步工作展望第164-167页
参考文献第167-175页
致谢第175-177页
作者简历及攻读学位期间发表的学术论文与研究成果第177页

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