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面向MIMO基带干扰消除的高灵活性异构多核体系结构设计与实现

摘要第13-15页
ABSTRACT第15-17页
第一章 绪论第18-30页
    1.1 无线通信发展概述第18-20页
    1.2 基带信号处理的发展趋势与挑战第20-21页
    1.3 基带信号处理平台发展现状第21-25页
        1.3.1 SDR平台发展现状第22-24页
        1.3.2 MIMO干扰消除相关背景第24页
        1.3.3 小结第24-25页
    1.4 研究方法与技术路线第25-29页
        1.4.1 算法分析第25-26页
        1.4.2 体系结构设计第26-28页
        1.4.3 硬件设计第28-29页
    1.5 论文组织第29-30页
第二章 MIMO无线通信系统基带仿真模型第30-60页
    2.1 无线信道模型第30-43页
        2.1.1 理论模型第31-39页
        2.1.2 仿真模型第39-42页
        2.1.3 简化仿真模型第42-43页
    2.2 基带仿真模型第43-55页
        2.2.1 802.11简介第43-44页
        2.2.2 802.11acPHY数据包结构第44-50页
        2.2.3 发射端数据处理第50-53页
        2.2.4 接收端数据处理第53-55页
    2.3 基于WARP的室内传输实测第55-58页
        2.3.1 WARP平台简介第55-57页
        2.3.2 WARPlab非实时测试第57-58页
    2.4 本章小结第58-60页
第三章 MIMO干扰消除算法性能及其鲁棒性研究第60-88页
    3.1 干扰消除算法第60-66页
        3.1.1 线性干扰消除算法第61-62页
        3.1.2 非线性干扰消除算法第62-66页
    3.2 THP衍生算法第66-74页
        3.2.1 优化SNR的THP算法第67-70页
        3.2.2 优化MSE的THP算法第70-71页
        3.2.3 格基规约辅助THP第71-74页
    3.3 干扰消除算法的性能第74-81页
        3.3.1 理想信道仿真第74-77页
        3.3.2 基于802.11ac标准的MIMOOFDM系统仿真第77-81页
    3.4 低复杂度鲁棒干扰消除算法第81-86页
        3.4.1 信道状态信息误差第81-83页
        3.4.2 鲁棒THP设计第83-84页
        3.4.3 实验结果第84-86页
    3.5 本章小结第86-88页
第四章 干扰消除及其预处理算法硬件实现可行性分析第88-112页
    4.1 数值精度需求第88-98页
        4.1.1 浮点数的表示第89-90页
        4.1.2 浮点运算第90-95页
        4.1.3 仿真结果第95-98页
    4.2 并行潜力分析第98-104页
        4.2.1 线性算法并行潜力第99-103页
        4.2.2 非线性算法并行潜力第103-104页
    4.3 计算复杂度分析第104-107页
        4.3.1 线性算法复杂度第105-106页
        4.3.2 非线性算法复杂度第106-107页
    4.4 硬件实现代价比较第107-109页
    4.5 干扰消除算法计算特征分析第109-110页
    4.6 本章小结第110-112页
第五章 面向MIMO干扰消除的灵活异构多核体系结构:蓝蛸(Octopus cyanea)第112-142页
    5.1 相关工作介绍第112-114页
    5.2 顶层设计思路第114-116页
    5.3 高灵活性计算核设计第116-124页
        5.3.1 拓扑结构第116-118页
        5.3.2 流水线结构第118页
        5.3.3 控制与数据接口第118-120页
        5.3.4 取指阶段第120-121页
        5.3.5 译指阶段第121页
        5.3.6 执行阶段第121-124页
    5.4 调度核设计第124-131页
        5.4.1 调度核流水线第124页
        5.4.2 计算核接口第124-125页
        5.4.3 存储接口第125-127页
        5.4.4 存储系统设计第127-129页
        5.4.5 排序单元第129-130页
        5.4.6 取指阶段第130页
        5.4.7 译指阶段第130页
        5.4.8 执行阶段第130-131页
        5.4.9 访存阶段第131页
    5.5 处理器辅助设计工具第131-137页
        5.5.1 nML语言第132-137页
        5.5.2 PDG语言第137页
    5.6 后端实现第137-140页
        5.6.1 综合结果第137-139页
        5.6.2 版图实现第139-140页
    5.7 本章小结第140-142页
第六章 蓝蛸编程模型及应用映射第142-168页
    6.1 计算核指令集介绍第142-148页
        6.1.1 运算类指令第142-145页
        6.1.2 控制类指令第145-146页
        6.1.3 示例代码第146-148页
    6.2 调度核指令集介绍第148-153页
        6.2.1 数据服务类第148-152页
        6.2.2 控制类第152页
        6.2.3 基本ALU类第152-153页
        6.2.4 中断服务类第153页
    6.3 应用映射第153-161页
        6.3.1 映射策略与步骤第153-155页
        6.3.2 线性干扰消除算法映射第155-158页
        6.3.3 非线性干扰消除算法映射第158-161页
    6.4 算法映射结果第161-167页
        6.4.1 硬件资源使用率第161-163页
        6.4.2 功耗分析第163-164页
        6.4.3 与现有工作的比较第164-167页
    6.5 本章小结第167-168页
第七章 结束语第168-172页
    7.1 论文工作总结第168-169页
    7.2 课题研究展望第169-172页
致谢第172-174页
参考文献第174-186页
作者在学期间取得的学术成果第186-188页
附录A第188-209页
    A.1 计算核浮点加法的PDG实现第188-189页
    A.2 计算核控制器的PDG实现第189-191页
    A.3 边界求逆算法在控制核上的代码第191-194页
    A.4 边界求逆算法在计算核A上的代码第194-198页
    A.5 边界求逆算法在计算核B上的代码第198-202页
    A.6 边界求逆算法在计算核C上的代码第202-206页
    A.7 边界求逆算法在计算核D上的代码第206-209页

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