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12位200MS/s流水线模数转换器研究与实现

摘要第3-4页
abstract第4-5页
第1章 绪论第9-14页
    1.1 论文的研究背景及意义第9-10页
    1.2 国内外研究现状第10-11页
    1.3 论文的研究目标、研究内容和主要创新点第11-12页
    1.4 论文的章节安排第12-14页
第2章 流水线模数转换器的基本原理第14-20页
    2.1 模数转换器的基本原理第14-15页
    2.2 模数转换器的性能参数第15-17页
        2.2.1 静态误差参数第15-16页
        2.2.2 动态性能参数第16-17页
    2.3 流水线模数转换器电路结构第17-20页
        2.3.1 流水线ADC结构第17-20页
第3章 流水线ADC误差来源分析及系统建模第20-31页
    3.1 流水线ADC的误差来源分析第20-27页
        3.1.1 系统噪声源分析第20-21页
        3.1.2 MOS开关引起的误差第21-23页
        3.1.3 运算放大器引起的误差第23-25页
        3.1.4 电容失配误差第25页
        3.1.5 子ADC误差第25页
        3.1.6 时钟抖动引起的误差第25-27页
    3.2 流水线ADC的Simulink建模第27-28页
        3.2.1 流水线ADC建模第27-28页
    3.3 本课题提出的流水线 ADC 系统指标及系统架构第28-31页
        3.3.1 流水线ADC系统指标第28页
        3.3.2 流水线ADC系统架构第28-31页
第4章 流水线ADC单元电路研究与设计第31-59页
    4.1 采样保持电路第31-40页
        4.1.1 采样保持电路结构的选择第31-32页
        4.1.2 采样保持电路指标推算第32-34页
        4.1.3 运算放大器设计第34-37页
        4.1.4 栅型自举开关第37-39页
        4.1.5 采样保持电路整体仿真第39-40页
    4.2 2.5bit/stage流水级电路设计第40-45页
        4.2.1 子ADC第41-43页
        4.2.2 MDAC电路设计第43-44页
        4.2.3 2.5bit流水级电路整体仿真第44-45页
    4.3 延迟锁相环电路设计第45-54页
        4.3.1 采用延迟锁相环设计考虑第45-46页
        4.3.2 延迟锁相环基本原理第46-47页
        4.3.3 延迟锁相环系统结构第47页
        4.3.4 鉴相器第47-49页
        4.3.5 全差分电荷泵环路第49页
        4.3.6 压控延迟线第49-50页
        4.3.7 两项非交叠时钟电路设计第50-51页
        4.3.8 延迟锁相环整体电路仿真第51-54页
    4.4 带隙基准电路设计第54-59页
第5章 版图设计第59-71页
    5.1 版图设计通用流程第59-62页
    5.2 版图设计通用规则第62-63页
    5.3 版图特殊设计考虑第63-66页
        5.3.1 器件匹配第64页
        5.3.2 静电保护第64-65页
        5.3.3 闩锁效应第65-66页
        5.3.4 天线效应第66页
    5.4 流水线ADC电路关键模块版图设计第66-71页
        5.4.1 采样保持电路版图第66-67页
        5.4.2 流水线级间电路版图第67页
        5.4.3 ADC_CORE电路版图第67-68页
        5.4.4 延迟锁相环DLL电路版图第68-69页
        5.4.5 12位200MS/s流水线ADC整体电路版图第69-71页
第6章 流水线ADC的整体仿真及芯片测试第71-80页
    6.1 流水线ADC整体电路仿真第71-72页
    6.2 芯片测试方案第72-74页
        6.2.1 测试过程需要注意事项第72-73页
        6.2.2 测试方案及测试系统的搭建第73-74页
    6.3 芯片测试结果对比分析第74-80页
第7章 总结与展望第80-83页
    7.1 工作总结第80-81页
    7.2 未来展望第81-83页
参考文献第83-87页
致谢第87-89页
个人简历、在学期间发表的学术论文与研究成果第89页

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