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在FPGA中利用SoftSerDes技术实现信号串并转换的研究

摘要第1-5页
Abstract第5-8页
第一章 绪论第8-12页
   ·SerDes的发展现状第8-9页
   ·SERDES结构简介第9-10页
   ·SoftSerDes技术第10-11页
   ·论文的主要工作及结构第11-12页
第二章 SerDes技术原理第12-20页
   ·高速数字串行通信过程模型第12页
   ·SoftSerDes技术第12-20页
     ·时钟产生单元第13-14页
     ·数据抽样延迟线第14-16页
     ·数据恢复状态机第16页
     ·复用器与解复用器第16-19页
     ·输出弹性缓冲器第19-20页
第三章 SoftSerDes的关键技术第20-35页
   ·抽样延迟线的设计第20-23页
     ·两种基本的抽样延迟线第21-22页
     ·可选择的抽样延时线第22-23页
   ·串行通信与时钟恢复第23-33页
     ·信号传输模式第24-25页
     ·时钟数据恢复技术第25-26页
     ·基于锁相环的时钟数据恢复器(CDR)模型结构第26-27页
     ·数据恢复状态机的原理第27-33页
   ·字节调整单元第33-35页
第四章 SoftSerDes的眼图及误码率第35-43页
   ·信号表现第35-37页
     ·眼图(Eyediagram)第35页
     ·码间干扰(Inter-symbolic Interference)第35-36页
     ·定时抖动(Timing Jitter)第36-37页
   ·眼图及其常见问题描述第37-41页
     ·眼图的概念第37-38页
     ·眼图的测量原理第38-39页
     ·眼图常见的问题第39-41页
   ·误码率的影响因素第41-43页
第五章 FPGA的开发流程第43-50页
   ·选用CPLD/FPGA及方案评估第43-45页
   ·源程序的编写第45页
   ·前仿真第45-46页
   ·综合第46-47页
   ·布局布线第47-48页
   ·后仿真第48页
   ·下载与调试第48页
   ·总结第48-50页
第六章 SoftSerDes在FPGA上的实现第50-58页
   ·SoftSerDes模块的介绍第50-51页
   ·SoftSerDes的仿真第51-52页
   ·SoftSerDes的综合与布局布线第52-56页
   ·下载与调试第56-58页
第七章 结论第58-59页
致谢第59-60页
参考文献第60页

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