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X微处理器可编程中断控制系统的设计与验证

摘要第1-9页
ABSTRACT第9-10页
第一章 绪论第10-12页
 §1.1 课题的研究背景第10页
 §1.2 课题研究的主要内容第10页
 §1.3 论文的结构第10-12页
第二章 中断系统的研究与发展第12-25页
 §2.1 中断与中断系统第12页
 §2.2 中断系统与可编程中断控制器之间的关系第12-13页
 §2.3 中断系统的发展第13-15页
 §2.4 PENTIUM处理器的中断系统和中断处理过程第15-24页
  2.4.1 中断类型第16-19页
  2.4.2 异常和中断向量第19-21页
  2.4.3 中断描述符表第21-22页
  2.4.4 中断处理过程第22-24页
 §2.5 本章小节第24-25页
第三章 高级可编程中断控制器(APIC)的概要设计第25-43页
 §3.1 APIC的系统结构第25页
 §3.2 I/O APIC第25-26页
 §3.3 XL-APIC第26-37页
  3.3.1 XL-APIC的寄存器第27-29页
  3.3.2 XL-APIC的配置模式第29页
  3.3.3 XL-APIC的中断类型第29-34页
  3.3.4 XL-APIC的工作模式第34-37页
 §3.4 APIC总线第37-39页
  3.4.1 APIC总线上的消息第37-38页
  3.4.2 APIC总线仲裁第38-39页
 §3.5 APIC系统的工作过程第39-42页
  3.5.1 中断请求产生并递交阶段第39-41页
  3.5.2 处理器接受中断请求并服务阶段第41页
  3.5.3 中断结束阶段第41-42页
 §3.6 本章小节第42-43页
第四章 XL-APIC的详细设计第43-58页
 §4.1 XL-APIC的总体设计第43页
 §4.2 中断接收/发送逻辑的设计第43-45页
 §4.3 寄存器文件的设计第45-50页
  4.3.1 寄存器读写电路的设计第45-47页
  4.3.2 寄存器体的设计第47-50页
 §4.4 中断产生逻辑的设计第50-54页
  4.4.1 定时/计数器中断产生逻辑第50-54页
  4.4.2 产生ERROR、LINT0、LINT1和IPI中断第54页
 §4.5 优先权判别逻辑的设计第54-57页
 §4.6 本章小节第57-58页
第五章 XL-APIC的功能验证第58-65页
 §5.1 子模块级功能验证第58-61页
  5.1.1 寄存器读写电路的验证第58-59页
  5.1.2 定时/计数器产生逻辑的功能验证第59-61页
 §5.2 模块级功能验证第61-63页
  5.2.1 对寄存器文件的验证第61页
  5.2.2 对中断接收/发送逻辑的验证第61-62页
  5.2.3 对中断产生逻辑的验证第62页
  5.2.4 对优先权判别逻辑的验证第62-63页
 §5.3 系统级验证第63-64页
 §5.4 本章小节第64-65页
第六章 可流水的高级可编程中断控制器(SAPIC)系统第65-68页
 §6.1 SAPIC系统的优越性第65-66页
  6.1.1 I/O xAPIC的功能可以被集成到I/O设备中第65页
  6.1.2 使用系统总线代替APIC总线发送中断第65-66页
  6.1.3 SAPIC系统支持中断的批处理第66页
  6.1.4 从基于引脚的中断机制到基于信号的中断机制第66页
 §6.2 外部中断请求的处理过程第66-67页
  6.2.1 I/O xAPIC的任务第66-67页
  6.2.2 中断在I/O总线上的处理第67页
  6.2.3 桥控制器的任务第67页
  6.2.4 系统总线上的中断事务第67页
 §6.3 本章小节第67-68页
第七章 结束语第68-69页
 §7.1 全文工作总结第68页
 §7.2 对未来工作的展望第68-69页
致谢第69-70页
附录:攻读硕士期间发表的论文第70-71页
参考文献第71-72页

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