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基于FPGA的UHF RFID阅读器基带接收电路研究

摘要第5-6页
Abstract第6页
专用术语注释表第9-10页
第一章 绪论第10-17页
    1.1 引言第10-11页
    1.2 选题的意义和背景第11-15页
        1.2.1 RFID 背景第11-12页
        1.2.2 RFID 国内外发展现状第12-13页
        1.2.3 阅读器的发展趋势第13页
        1.2.4 RFID 系统的频段和应用领域第13-15页
    1.3 本文的主要研究内容第15-17页
        1.3.1 论文的主要工作第15页
        1.3.2 论文结构安排第15-17页
第二章 系统设计方案第17-26页
    2.1 RFID 系统结构第17-19页
        2.1.1 RFID 阅读器结构第17-18页
        2.1.2 RFID 标签结构第18-19页
    2.2 RFID 协议标准第19-22页
        2.2.1 RFID 标准机构与体系结构第19-20页
            一、RFID 国际标准机构第19页
            二、RFID 标准的体系结构第19-20页
        2.2.2 RFID 标准现状第20-22页
    2.3 系统设计第22-25页
        2.3.1 整体框架设计第22-23页
        2.3.2 时序图设计第23-25页
    2.4 本章小结第25-26页
第三章 控制模块及微矫正电路设计第26-37页
    3.1 控制模块设计第26-30页
        3.1.1 时序状态机第26-28页
        3.1.2 控制模块的基本原理第28-29页
        3.1.3 控制器仿真实现第29-30页
    3.2 分频模块第30-32页
        3.2.1 分频器意义第30-31页
        3.2.2 分频原理第31-32页
        3.2.3 分频器仿真实现第32页
    3.3 波形微矫正模块第32-36页
        3.3.1 占空比矫正第33-34页
        3.3.2 频率矫正第34-36页
    3.4 本章小结第36-37页
第四章 处理器模块设计第37-57页
    4.1 FM0 译码模块设计第37-40页
        4.1.1 基带数据的 FM0 编码格式第37-38页
        4.1.2 T=>R 过程 FM0 前同步码第38-39页
        4.1.3 FM0 解码实现第39-40页
    4.2 Miller 译码模块设计第40-43页
        4.2.1 基带数据的 Miller 编码格式第40-42页
        4.2.2 T=>R 过程 Miller 前同步码第42-43页
        4.2.3 Miller 解码实现第43页
    4.3 数据帧处理单元第43-49页
        4.3.1 数据截获机第44-46页
        4.3.2 串/并转换器第46-47页
        4.3.3 串/并转换器仿真实现第47-49页
    4.4 CRC 校验模块设计第49-56页
        4.4.1 CRC 校验的基本原理第49-50页
        4.4.2 CRC 校验的设计第50-53页
        4.4.3 串并结合算法原理第53-55页
        4.4.4 CRC 校验仿真实现第55-56页
    4.5 本章小结第56-57页
第五章 用 ISE14.3 开发 FPGA第57-65页
    5.1 FPGA 软件开发环境 ISE 套件第57-58页
        5.1.1 ISE 简要介绍第57页
        5.1.2 ISE 功能简介第57-58页
    5.2 系统模型封装第58-59页
        5.2.1 Xilinx IP Core 的使用第58-59页
    5.3 基于 ISE 的系统模块开发流程第59-64页
        5.3.1 基于 Xilinx XST 的综合第59-61页
        5.3.2 基于 ISE 的系统仿真测试第61-64页
    5.4 本章小结第64-65页
第六章 总结与展望第65-67页
    6.1 总结第65页
    6.2 展望第65-67页
参考文献第67-69页
附录1 攻读硕士学位期间撰写的论文第69-70页
致谢第70页

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