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基于USB3.0的高速数据传输系统的研究与设计

摘要第5-6页
ABSTRACT第6-7页
第一章 绪论第11-18页
    1.1 课题背景第11-14页
        1.1.1 课题来源第11页
        1.1.2 USB2.0 接.的局限第11-12页
        1.1.3 几种高速接.比较第12-14页
    1.2 国内外研究现状第14页
    1.3 论文的主要内容和章节安排第14-18页
        1.3.1 本课题的主要工作第14-16页
        1.3.2 本论文的章节安排第16-18页
第二章 系统相关技术简介及总体方案第18-28页
    2.1 FPGA技术及结构第18-22页
        2.1.1 FPGA技术简介第18页
        2.1.2 FPGA实现原理第18-19页
        2.1.3 FPGA内部结构第19-22页
    2.2 USB3.0 协议简介第22-24页
    2.3 USB3.0 接.芯片的选择第24-25页
    2.4 系统总体设计方案第25-27页
    2.5 本章小结第27-28页
第三章 系统硬件详细设计第28-44页
    3.1 系统总体设计第28页
    3.2 FPGA模块设计第28-31页
        3.2.1 FPGA器件选型第28-29页
        3.2.2 FPGA配置电路设计第29-30页
        3.2.3 FPGA复位电路设计第30页
        3.2.4 FPGA时钟电路设计第30-31页
    3.3 USB3.0 接.芯片电路设计第31-39页
        3.3.1 USB3.0 接.芯片介绍第31-33页
        3.3.2 USB3.0 模块配置电路设计第33-34页
        3.3.3 USB3.0 模块接.电路设计第34-36页
        3.3.4 USB3.0 模块时钟电路设计第36-37页
        3.3.5 USB3.0 模块的复位电路设计第37页
        3.3.6 USB3.0 模块与FPGA接.电路设计第37-39页
    3.4 电源模块电路设计第39-40页
        3.4.1 电源输入回路设计第39-40页
        3.4.2 电源转换电路设计第40页
    3.5 硬件PCB设计第40-43页
        3.5.1 电磁兼容设计第41页
        3.5.2 信号完整性设计第41-42页
        3.5.3 电源完整性设计第42-43页
    3.6 本章小结第43-44页
第四章 FPGA逻辑详细设计第44-56页
    4.1 系统逻辑总体设计第44-45页
    4.2 Slave FIFO时序接.模块详细设计第45-48页
        4.2.1 Slave FIFO接.和时序第45-47页
        4.2.2 接.时序状态机设计第47-48页
    4.3 包接收发送模块第48-49页
    4.4 时钟复位模块第49-51页
        4.4.1 系统时钟第49-50页
        4.4.2 系统复位第50-51页
    4.5 双. RAM控制模块第51-53页
    4.6 跨时钟域处理第53-55页
        4.6.1 慢时钟域到快时钟域电路第53-54页
        4.6.2 快时钟域到慢时钟域电路第54-55页
    4.7 本章小结第55-56页
第五章 软件详细设计第56-69页
    5.1 固件程序设计第56-61页
        5.1.1 固件开发环境第56-57页
        5.1.2 固件程序开发第57-60页
        5.1.3 低功耗的考虑第60-61页
    5.2 驱动程序设计第61-66页
        5.2.1 WDM模式的特点第61-62页
        5.2.2 USB总线及驱动程序层次结构第62-63页
        5.2.3 WDM驱动初始化第63-64页
        5.2.4 即插即用( PnP)第64-65页
        5.2.5 电源管理( Power Management)第65页
        5.2.6 USB设备的读写第65-66页
    5.3 应用程序设计第66-68页
        5.3.1 上位机数据通信处理流程第66-67页
        5.3.2 应用程序与驱动交互第67页
        5.3.3 成果演示第67-68页
    5.4 本章小结第68-69页
第六章 系统调试与分析第69-73页
    6.1 系统调试过程第69-70页
    6.2 系统联试及结果分析第70-72页
    6.3 本章小结第72-73页
第七章结论第73-75页
    7.1 本文的主要贡献第73-74页
    7.2 下一步工作的展望第74-75页
致谢第75-76页
参考文献第76-78页

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