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支持远程可重配置的网络测试仪器研究与实现(BitTester)

致谢第1-6页
中文摘要第6-7页
ABSTRACT第7-11页
1 引言第11-29页
   ·研究背景第11-21页
     ·产品测试工作的重要性第11-12页
     ·IT行业产品测试发展的趋势第12-15页
     ·基于FPGA技术的测试仪器在测试领域中的应用第15-17页
     ·网络数据通信设备的测试需求第17-18页
     ·FPGA技术在网络数据通信领域的应用第18-21页
   ·可重用设计方法学第21-25页
     ·基于硬件描述语言的IP核可重用设计方法第22-23页
     ·基于可编程技术的系统可重构设计方法第23页
     ·基于网络技术的可重配置系统工程设计方法第23-24页
     ·基于EDA设计环境的可重用原型算法设计与验证方法第24-25页
   ·国内外网络数据通信设备测试发展现状第25-26页
     ·现有网络数据通信设备测试软件第25页
     ·现有网络数据通信设备测试仪器第25页
     ·面临的问题第25-26页
   ·本文的研究内容及特色性工作第26-27页
     ·关键技术第26-27页
     ·所解决的问题第27页
     ·特色工作与创新点第27页
   ·本文的组织结构第27-29页
2 BitTester系统结构概览第29-40页
   ·系统设计原理第29-38页
     ·系统级的自顶向下设计第29-30页
     ·基于可重用方法学的远程可重配置构架第30-31页
     ·多通道并行多级流水线结构第31-33页
     ·AXI4总线家族第33-38页
     ·与原始NetFPGA10G示例工程的构架区别与优势第38页
   ·系统主要功能第38页
   ·系统构架划分与软硬件协同设计第38-39页
     ·硬件部分第39页
     ·软件部分第39页
   ·本章小结第39-40页
3 BitTester硬件结构设计与实现第40-98页
   ·硬件构架分层结构第40页
   ·数据层面——DTP第40-71页
     ·输入报文时间戳IP核第42-45页
     ·输入报文过滤IP核第45-51页
     ·输入报文计数器IP核第51-56页
     ·Block-RAM缓存队列IP核第56-63页
     ·报文发送速率限制IP核第63-68页
     ·报文延迟IP核第68-71页
     ·发送报文计数器IP核第71页
   ·控制层面——CTP第71-93页
     ·MicroBlaze软核CPU与AXI4-Lite总线控制器IP核第72-73页
     ·UART串口控制器IP核第73-76页
     ·Block-RAM缓存队列控制器IP核第76-84页
     ·速率限制控制器IP核第84-88页
     ·输入报文计数控制器IP核第88-91页
     ·输出报文计数控制器IP核第91-92页
     ·远程可重配置控制器IP核第92-93页
   ·远程可重配置层面——RRP第93-96页
     ·CPLD的控制逻辑第94-96页
   ·本章小结第96-98页
4 BitTester软件部分设计与实现第98-105页
   ·BitTester软件控制部分第98-103页
     ·报文内容产生程序第98-100页
     ·参数配置程序第100-101页
     ·远程可重配置控制程序第101-103页
   ·用户交互程序第103-104页
   ·本章小结第104-105页
5 系统测试与结果分析第105-114页
   ·BitTester单端口流量吞吐率与现有测试仪器横向对比测试第105-108页
     ·测试环境第105页
     ·测试方法第105-106页
     ·测试结果第106-107页
     ·结果分析第107-108页
   ·BitTester系统整体流量吞吐率与现有测试仪器横向对比测试第108-110页
     ·测试环境第108页
     ·测试方法第108-109页
     ·测试结果第109页
     ·结果分析第109-110页
   ·远程可重配置工程测试第110-113页
     ·测试环境第110页
     ·测试方法第110-111页
     ·测试结果第111-113页
   ·本章小结第113-114页
6 论文工作总结与展望第114-117页
   ·论文工作总结第114-115页
   ·展望第115-117页
参考文献第117-119页
作者简历第119-121页
学位论文数据集第121页

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