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基于FPGA的可编程精确网络报文构造和发送单元的设计与实现

摘要第3-4页
Abstract第4页
1 绪论第10-17页
    1.1 课题的研究背景和意义第10页
    1.2 网络性能测试仪的国内外研究现状第10-11页
    1.3 互联网标准网络协议第11-15页
        1.3.1 IPv4协议第12-13页
        1.3.2 IPv6协议第13-14页
        1.3.3 TCP协议第14-15页
        1.3.4 UDP协议第15页
    1.4 论文主要工作及内容安排第15-17页
        1.4.1 论文的主要工作第15-16页
        1.4.2 论文的内容安排第16-17页
2 网络性能测试仪系统总体构架第17-23页
    2.1 网络性能测试仪系统原理分析第17页
    2.2 网络性能测试仪系统总体构架第17-18页
    2.3 硬件方案第18-20页
    2.4 FPGA设计方案第20-22页
    2.5 本章小结第22-23页
3 基于Serdes接口的网络报文构造和发送单元的设计与实现第23-42页
    3.1 网络报文构造和发送单元总体设计方案第23-24页
    3.2 网络性能测试仪系统通信协议第24-29页
        3.2.1 接口协议第24-25页
        3.2.2 上位机命令协议第25-28页
        3.2.3 FPGA反馈协议第28-29页
    3.3 网络报文的构造模块第29-37页
        3.3.1 命令解析模块第29-30页
        3.3.2 流信息提取模块第30-33页
        3.3.3 流信息存储模块第33-34页
        3.3.4 字段选择模块第34-35页
        3.3.5 字段构造模块第35-36页
        3.3.6 报文整合模块第36-37页
    3.4 网络报文的发送模块第37-41页
        3.4.1 端口设置模块第38-39页
        3.4.2 信息返回模块第39-40页
        3.4.3 发送控制信息统计模块第40-41页
        3.4.4 报文发送模块第41页
    3.5 本章小结第41-42页
4 基于Serdes接口的网络报文构造和发送单元的调试第42-56页
    4.1 调试环境第42-43页
    4.2 网络报文构造和发送单元的功能性调试第43-51页
        4.2.1 Serdes总线接口调试第43-44页
        4.2.2 网络报文构造和发送单元发送接口调试第44-47页
        4.2.3 网络报文构造和发送单元的各模式调试第47-51页
    4.3 网络报文构造和发送单元性能调试第51-55页
    4.4 本章小结第55-56页
5 基于PCIe接口的网络报文构造和发送单元的设计第56-70页
    5.1 网络性能测试仪总体结构改进第56-57页
    5.2 PCIe接口的设计与实现第57-62页
        5.2.1 PCIe协议第57-60页
        5.2.2 DMA控制器第60-62页
    5.3 PCIe接口调试第62-68页
    5.4 基于PCIe接口的网络报文构造和发送单元的实现第68-69页
    5.5 本章小结第69-70页
6 总结第70-71页
致谢第71-72页
参考文献第72-75页
附录第75页

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