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基于TMS320C6678的AVS2视频解码器优化及系统实现

摘要第4-5页
ABSTRACT第5页
第一章 绪论第9-15页
    1.1 引言第9页
    1.2 视频压缩编码的发展现状第9-12页
        1.2.1 国际视频压缩编码的发展第10-11页
            1.2.1.1 H.26x系列视频标准第10-11页
            1.2.1.2 MPEG系列视频标准第11页
        1.2.2 我国视频压缩编码的研究现状及发展第11-12页
    1.3 课题研究的背景、意义及内容第12-14页
        1.3.1 课题研究背景第12-13页
        1.3.2 课题研究意义第13页
        1.3.3 课题研究内容第13-14页
    1.4 论文主要内容及结构安排第14-15页
第二章 AVS2视频编解码标准简介第15-25页
    2.1 AVS2视频编解码框架第15-16页
    2.2 AVS2视频解码关键技术第16-22页
        2.2.1 熵解码第17-18页
        2.2.2 量化系数解码及逆扫描第18-19页
        2.2.3 反量化与反变换第19-20页
        2.2.4 帧间预测第20页
        2.2.5 帧内预测第20-21页
        2.2.6 环路滤波第21-22页
    2.3 AVS2与国际标准(H.264/ MPEG-4)的比较第22-24页
        2.3.1 技术对比和性能差异第22-24页
    2.4 本章小结第24-25页
第三章 TMS320C6678开发平台简介第25-40页
    3.1 DSP简述第25-28页
        3.1.1 DSP发展历程第25-26页
        3.1.2 DSP的特性第26-27页
        3.1.3 DSP芯片的选择第27-28页
    3.2 TMS320C6678概述第28-34页
        3.2.1 TMS320C6678的架构第28-29页
        3.2.2 TMS320C6678的内核第29-31页
        3.2.3 TMS320C6678的存储系统第31-33页
        3.2.4 TMS320C6678的EDMA控制器第33-34页
    3.3 TI DSP开发第34-37页
        3.3.1 TI DSP开发工具CCS简介第34-35页
        3.3.2 CCS环境DSP软件开发第35-37页
    3.4 基于TMS320C6678的并行软件设计关键技术第37-39页
        3.4.1 并行模式选择第37页
        3.4.2 核间通信第37-39页
        3.4.3 存储器缓存一致性第39页
    3.5 本章小结第39-40页
第四章 AVS2视频解码器的多路双核解码实现第40-63页
    4.1 解码器设计的系统要求第40-43页
    4.2 AVS2视频解码器的代码分析第43-44页
    4.3 AVS2视频解码器的移植第44-49页
        4.3.1 代码删减第45页
        4.3.2 规范数据类型第45页
        4.3.3 数据流的读写第45-46页
        4.3.4 内存分配第46-48页
        4.3.5 库函数的引用第48页
        4.3.6 工程编译选项第48-49页
    4.4 AVS2视频解码器的平台优化第49-54页
        4.4.1 解码器优化的整体方案第49-50页
        4.4.2 代码结构优化第50-52页
        4.4.3 存储器优化第52-53页
        4.4.4 线性汇编优化第53页
        4.4.5 CACHE优化及EDMA使用第53-54页
    4.5 基于优化的AVS2视频双核解码实现第54-59页
        4.5.1 帧内双核并行解码方案第55-57页
        4.5.2 帧间双核并行解码方案第57-59页
    4.6 满足系统要求的多功能解码器设计及联调第59-62页
        4.6.1 满足系统要求的多功能解码器第59-60页
        4.6.2 系统联调第60-62页
    4.7 本章小结第62-63页
第五章 总结及展望第63-65页
    5.1 论文总结第63页
    5.2 后续工作的展望第63-65页
参考文献第65-68页
发表论文及参加科研情况说明第68-69页
致谢第69-70页

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