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面向BWDSP的SIMD编译优化技术研究与实现

摘要第5-6页
ABSTRACT第6-7页
第1章 绪论第11-19页
    1.1 研究背景第11-15页
        1.1.1 指令级并行第11-12页
        1.1.2 SMD编译优化第12-13页
        1.1.3 分簇体系结构的VLIW DSP第13-14页
        1.1.4 分簇VLIW DSP对编译器的挑战第14-15页
    1.2 研究内容与意义第15-16页
        1.2.1 研究内容第15页
        1.2.2 研究意义第15-16页
    1.3 论文组织第16-19页
第2章 硬件平台及编译基础设施第19-29页
    2.1 BWDSP概述第19页
    2.2 BWDSP体系结构第19-23页
        2.2.1 硬件架构第19-21页
        2.2.2 指令集第21-23页
    2.3 Open64编译基础设施第23-24页
        2.3.1 Open64编译器概述第23页
        2.3.2 Open64体系结构第23-24页
    2.4 Open64后端中间表示第24-28页
        2.4.1 中间表示WHIRL第24-26页
        2.4.2 中间表示CGIR第26-27页
        2.4.3 WHIRL到CGIR的转换第27-28页
    2.5 本章小结第28-29页
第3章 基于中间语言WHIRL的SIMD编译优化技术第29-47页
    3.1 引言第29页
    3.2 循环嵌套优化第29-33页
    3.3 SMD编译优化实现框架概述第33-34页
    3.4 SIMD编译优化预分析第34-37页
        3.4.1 确定可向量化候选循环第34-35页
        3.4.2 SIMD预优化第35-37页
    3.5 SIMD代码生成第37-39页
    3.6 intrinsic机制实现第39-42页
    3.7 实验结果与分析第42-45页
    3.8 本章小结第45-47页
第4章 面向BWDSP的编译器后端SIMD编译相关优化第47-67页
    4.1 引言第47页
    4.2 OCC编译器后端优化模块框架第47-48页
    4.3 机器描述第48-50页
    4.4 SIMD指令注释第50-54页
    4.5 SIMD指令分簇第54-59页
        4.5.1 地址寄存器优化第54-55页
        4.5.2 SIMD指令分簇第55-59页
    4.6 SIMD分簇寄存器分配第59-61页
    4.7 SIMD指令调度第61-62页
    4.8 SIMD汇编输出第62-63页
    4.9 实验结果与分析第63-65页
    4.10 本章小结第65-67页
第5章 总结第67-71页
    5.1 本文工作第67-68页
    5.2 本文工作对BWDSP应用领域的意义和价值第68页
    5.3 本文贡献与创新之处第68-69页
    5.4 进一步工作第69-71页
参考文献第71-73页
附录1 插图索引第73-74页
附录2 表格索引第74-75页
致谢第75-77页
在读期间发表的学术论文第77-79页
攻读学位期间参加的科研项目第79页

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