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高效处理器容错技术研究与实现

摘要第1-12页
Abstract第12-14页
第一章 绪论第14-30页
   ·处理器的可靠性问题第14-15页
     ·处理器制造工艺不断进步第14页
     ·多核技术的发展第14-15页
     ·核间通信技术日益复杂第15页
   ·基本概念与相关工作第15-25页
     ·处理器容错研究基础第15-19页
     ·故障传播行为相关研究第19-20页
     ·容错技术相关研究第20-25页
   ·课题研究内容第25-27页
     ·硬件故障在以段为粒度的程序中的传播行为第26页
     ·容错处理器实现技术第26-27页
   ·本文的主要工作和创新第27-28页
   ·论文结构第28-30页
第二章 共享存储程序中单线程故障传播行为分析第30-52页
   ·故障模型与程序抽象第30-33页
     ·故障模型第30-31页
     ·共享存储程序特点分析第31-33页
   ·单线程错误传播行为概述第33-41页
     ·基本定义第33-36页
     ·指令级数据流错误传播行为分析第36-40页
     ·错误传播与容错第40-41页
   ·错误在指令段间传播行为分析第41-48页
     ·DCFG 与程序段第41-43页
     ·段内错误传播行为第43-48页
   ·基于错误传播行为的错误定位第48-51页
     ·错误定位方程第49-51页
     ·错误定位算法第51页
     ·基于错误定位分析的段式容错优化第51页
   ·本章小结第51-52页
第三章 基于共享变量并行程序的故障传播行为分析第52-72页
   ·基于共享变量的并行程序分段模型第52-54页
     ·基于共享变量的并行计算模型第52-53页
     ·程序分段相关定义第53-54页
   ·共享变量并行程序的分段结构第54-56页
   ·故障在不同并行分段结构中的传播行为第56-61页
   ·并行分段结构的转换第61-67页
     ·分段结构转换可行性研究第61-65页
     ·分段结构转换最优性研究第65-67页
   ·存储一致性模型对故障传播行为的影响第67-70页
   ·本章小结第70-72页
第四章 BRO-SOC 框架与 DoubleRun 容错处理器核第72-94页
   ·BRO-SOC 框架第72-77页
     ·背景:SOR 模型第72-73页
     ·BRO-SOC 框架思想第73-74页
     ·BRO-SOC 框架定义第74-77页
   ·DoubleRun 容错处理器核第77-86页
     ·以往研究方案分析第77-79页
     ·DoubleRun 设计方法学第79-80页
     ·容错事务与同步事件间的关系第80-81页
     ·DoubleRun 执行模型第81-82页
     ·DoubleRun 体系结构实现第82-86页
   ·实验评估第86-89页
     ·实验设置第86-87页
     ·DoubleRun 性能评估第87-88页
     ·容错计算时空开销第88-89页
   ·相关研究-用 SOCn模型总结以往研究方案第89-91页
   ·本章小结第91-94页
第五章 DoubleRun-MP:在并行环境下扩展 DoubleRun第94-118页
   ·问题的提出第94-95页
   ·设计概览第95-98页
   ·共享内存并行环境下的容错事务第98-103页
     ·划分并行程序得到容错事务第99-102页
     ·排序容错事务第102-103页
   ·DoubleRun-MP 体系结构实现第103-111页
     ·多版本状态缓存实现第103-105页
     ·cache 一致性协议第105-107页
     ·冗余执行一致性第107-110页
     ·状态提交与回滚机制第110-111页
     ·与存储一致性模型的兼容性第111页
   ·实验评估第111-116页
     ·实验设置第111-113页
     ·实验结果第113-116页
   ·本章小结第116-118页
第六章 结论与展望第118-122页
   ·工作总结第118-119页
   ·研究展望第119-122页
致谢第122-124页
参考文献第124-132页
作者在学期间取得的学术成果第132-134页
作者在学期间参加的科研项目第134页

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