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基于SOPC架构的IP核设计研究

摘要第5-6页
ABSTRACT第6页
缩略词表第13-15页
第一章 绪论第15-23页
    1.1 均衡技术的发展和研究意义第15-18页
        1.1.1 码间串扰第15-16页
        1.1.2 均衡的概念第16-17页
        1.1.3 均衡器的分类第17-18页
    1.2 SOPC技术的发展第18-21页
        1.2.1 可编程器件的发展第19-20页
        1.2.2 SOC技术的发展第20-21页
    1.3 系统的SOPC方案设计第21-22页
    1.4 论文结构安排第22-23页
第二章 SOPC的结构和原理第23-36页
    2.1 引言第23-24页
    2.2 MICROBLAZE软核处理器介绍第24-28页
        2.2.1 MicroBlaze的体系结构第24-26页
        2.2.2 MicroBlaze的结构特点第26-27页
        2.2.3 MicroBlaze的总线接第27页
        2.2.4 浮点运算单元第27-28页
    2.3 MICROBLAZE系统总线结构第28-32页
        2.3.1 PLB总线结构第28-30页
        2.3.2 IPIF的结构和应用第30-32页
    2.4 IP CORE复用技术第32页
    2.5 SOPC系统的开发流程第32-35页
    2.6 两种IP CORE的设计流程第35页
    2.7 本章小结第35-36页
第三章 BUSSGANG类盲均衡算法性能分析第36-47页
    3.1 引言第36页
    3.2 盲均衡的概念第36-37页
    3.3 BUSSGANG盲均衡算法概念第37-38页
    3.4 BUSSGANG性质的盲均衡算法第38-40页
        3.4.1 Sato算法第38页
        3.4.2 Godard算法第38-40页
        3.4.3 决策指向算法(DD)第40页
        3.4.4 BG算法第40页
    3.5 BUSSGANG性质盲均衡算法小结第40-45页
    3.6 CMA均衡的变步长算法及其特点分析第45-46页
    3.7 本章小结第46-47页
第四章 CMA均衡器的IP CORE设计第47-65页
    4.1 引言第47页
    4.2 设计方案论证第47-50页
        4.2.1 均衡器设计要求第47-48页
        4.2.2 方案的选择与可行性分析第48页
        4.2.3 变步长算法在MicroBlaze中的性能分析第48-50页
    4.3 基于SYSTEM GENERATOR的IP CORE设计流程介绍第50-52页
    4.4 IP CORE的设计第52-57页
        4.4.1 硬件部分的设计第53-56页
        4.4.2 硬件部分的时序分析第56页
        4.4.3 软件部分的设计第56-57页
    4.5 CMA均衡器IP CORE的定点仿真第57-62页
    4.6 CMA均衡器IP CORE的硬件测试第62-64页
    4.7 本章小结第64-65页
第五章 射频控制接.模块的IP CORE设计第65-78页
    5.1 引言第65页
    5.2 设计来源及要求第65-66页
    5.3 使用HDL实现IP CORE的设计流程第66-67页
    5.4 用户逻辑的设计第67-71页
        5.4.1 用户逻辑设计分析第67-68页
        5.4.2 用户逻辑设计方案第68-71页
    5.5 MICROBLAZE软件验证设计第71-72页
    5.6 软硬件协同测试第72-77页
        5.6.1 在线微处理器调试工具第72页
        5.6.2 基于SOPC的逻辑分析仪第72-74页
        5.6.3 软硬件协同测试结果第74-77页
    5.7 本章小结第77-78页
第六章 总结第78-80页
    6.1 主要工作及贡献第78页
    6.2 未来的学习和研究工作第78-80页
致谢第80-81页
参考文献第81-83页
攻读硕士学位期间取得的成果第83-84页
附表第84-86页

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