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基于DDS+PLL的宽带频率综合器的设计

摘要第1-6页
ABSTRACT第6-10页
第一章 绪论第10-19页
   ·工程背景第10-11页
   ·频率合成技术的发展过程第11-12页
   ·频率合成技术的近况与展望第12-13页
   ·论文要解决的问题第13-14页
   ·设计方案的选择第14-17页
   ·本文主要工作第17-19页
第二章 直接数字合成频率技术简介第19-35页
   ·引言第19页
   ·DDS 的原理基础和基本结构第19-23页
     ·DDS 的原理第20-21页
     ·DDS 的结构第21-23页
       ·相位累加器第21-22页
       ·波形查询表第22-23页
       ·DA 转换器第23页
   ·DDS 的数学综合第23-24页
   ·理想 DDS 的输出频谱第24-27页
   ·DDS 输出信号频谱杂散来源分析第27-34页
     ·DDS 的相位误差序列第28-29页
     ·相位截断产生的频谱影响第29-31页
     ·幅度值量化产生的频谱影响第31-34页
     ·数模转化器的非线性误差对频谱的影响第34页
   ·本章小结第34-35页
第三章 DDS 部分硬件电路设计第35-40页
   ·AD9858 简介第35-36页
   ·硬件电路设计及配置方式介绍第36-39页
   ·设计实物图及测试结果第39页
   ·本章小结第39-40页
第四章 锁相频率合成器简介第40-49页
   ·引言第40页
   ·锁相环的基本原理及结构第40-44页
     ·基本原理第40-42页
     ·锁相环结构第42-44页
       ·鉴相器(PD)第42-43页
       ·环路滤波器(LF)第43页
       ·压控振荡器(VCO)第43-44页
   ·锁相环环路相位模型第44-45页
   ·锁相环的主要特性分析第45-48页
     ·混频器频率配置第45-46页
     ·锁相环路的捕捉性第46-47页
     ·锁相环路噪声特性分析第47-48页
     ·锁相环路带宽的选择第48页
   ·本章小结第48-49页
第五章 锁相环部分硬件电路设计第49-58页
   ·ADF4106 简介第49-50页
   ·ADF4106 设计仿真第50-56页
   ·AD4106 硬件设计电路第56-57页
   ·本章小结第57-58页
第六章 宽带、高速频率综合器的工程设计第58-72页
   ·频综的总体技术指标分析第58-59页
   ·系统原理框图第59-71页
     ·300-350MHZ 信号产生模块组成及工作原理第61-64页
       ·晶振信号产生部分工作原理第61-62页
       ·杂散测试第62-63页
       ·FPGA 控制和 DDS 信号产生部分工作原理第63页
       ·主要技术指标分析第63-64页
     ·1-2GHZ 信号产生模块组成及工作原理第64-67页
       ·六个点频信号产生部分工作原理第64-65页
       ·开关选通混频部分工作原理第65-66页
       ·主要技术指标分析第66-67页
     ·2-7GHZ 信号产生模块组成及工作原理第67-69页
       ·五个点频信号产生部分工作原理第67页
       ·开关选通分段混频部分工作原理第67-68页
       ·主要技术指标分析第68-69页
     ·7-18GHZ 信号产生模块组成及工作原理第69-70页
       ·三个点频信号产生部分工作原理第69页
       ·开关选通分段混频部分工作原理第69-70页
       ·主要技术指标分析第70页
     ·结构设计第70页
     ·电磁兼容性设计第70-71页
   ·本章小结第71-72页
第七章 指标计算及测试结果分析第72-81页
   ·测试方法第72页
   ·指标计算及测试结果分析第72-76页
     ·300-350MHZ 信号产生模块指标计算及测试结果分析第73页
     ·1-2GHZ 信号产生模块指标计算及测试结果分析第73-75页
     ·2-7GHZ 信号产生模块指标计算及测试结果分析第75页
     ·7-18GHZ 信号产生模块指标计算及测试结果分析第75-76页
   ·系统测试结果第76-80页
   ·本章小结第80-81页
第八章 结论第81-83页
   ·本文的主要贡献第81-82页
   ·下一步工作的展望第82-83页
致谢第83-84页
参考文献第84-86页
攻硕期间取得的研究成果第86-87页

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