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HFC终端设备中的ASIC芯片体系结构研究及协议实现

中文摘要第1-5页
英文摘要第5-9页
1 绪论第9-15页
 1.1 课题背景第9页
 1.2 宽带网络技术综述第9-10页
 1.3 宽带接入的概念及特点第10页
 1.4 宽带接入技术方案比较第10-13页
  1.4.1 FTTH第10-11页
  1.4.2 ADSL第11-12页
  1.4.3 Ethernet第12页
  1.4.4 HFC第12-13页
 1.5 本课题的意义第13页
 1.6 本课题所作的工作第13-14页
 1.7 论文安排第14页
 1.8 本章小结第14-15页
2 HFC宽带接入网理论基础及其接口规范第15-21页
 2.1 HFC宽带接入网第15-17页
  2.1.1 HFC网络拓扑第15页
  2.1.2 HFC运行机制第15-17页
 2.2 射频接口规范第17-20页
  2.2.1 通信协议栈第17-19页
  2.2.2 MAC转发器第19-20页
  2.2.3 网络层及网络层以上第20页
  2.2.4 数据链路层第20页
 2.3 本章小结第20-21页
3 ASIC芯片的体系结构第21-35页
 3.1 总体结构第21-22页
 3.2 下行接收器第22-30页
  3.2.1 模拟前端第23-24页
  3.2.2 解调器第24-27页
  3.2.3 匹配均衡器第27-28页
  3.2.4 前向纠错第28-29页
  3.2.5 AGC环路第29-30页
  3.2.6 码元恢复环路第30页
  3.2.7 载波环路第30页
 3.3 上行发送器第30-31页
  3.3.1 突发编码逻辑第30-31页
  3.3.2 QAM调制器第31页
  3.3.3 D/A转换器第31页
 3.4 媒体访问控制器第31-34页
  3.4.1 下行功能模块第31-33页
  3.4.2 上行模块第33页
  3.4.3 DMA控制第33-34页
  3.4.4 杂项DMA控制第34页
 3.5 杂项控制第34页
  3.5.1 集成时钟PLL第34页
  3.5.2 CPU接口第34页
  3.5.3 JTAG接口第34页
 3.6 本章小结第34-35页
4 DOCSIS协议的实现第35-58页
 4.1 下行接收器功能的实现第35-37页
  4.1.1 接收器初始化第35页
  4.1.2 接收器的信道捕获第35-37页
  4.1.3 接收器性能监视第37页
 4.2 上行发送器功能的实现第37-39页
  4.2.1 突发发送第37-38页
  4.2.2 带有上行前端使能的连续发送第38-39页
  4.2.3 带有上行前端旁路的连续发送第39页
 4.3 下行MAC的实现第39-44页
  4.3.1 下行标头处理第39-41页
  4.3.2 MAC消息处理第41页
  4.3.3 正常运行过程中的消息过虑第41-43页
  4.3.4 初始化过程中的消息过滤第43页
  4.3.5 下行目的地址过滤第43-44页
 4.4 下行DES第44-45页
  4.4.1 ResidualBlockTermination第44页
  4.4.2 DES加载器模块第44-45页
  4.4.3 标头处理第45页
  4.4.4 DMA模块与CRC校验第45页
 4.5 MAP处理第45-46页
  4.5.1 MAP预分析器第45-46页
  4.5.2 MAPFIFO第46页
 4.6 DMA与存储器操作第46-50页
  4.6.1 内存接口第46-47页
  4.6.2 下行DMA第47-48页
  4.6.3 上行DMA第48-50页
 4.7 上行DMA操作第50-54页
  4.7.1 带宽分配映射分析第51-52页
  4.7.2 TDMA发送控制第52-54页
  4.7.3 数据请求包生成器第54页
 4.8 用户定时再生器第54页
 4.9 平滑时标时钟生成器第54-55页
 4.10 事件计数器第55-57页
 4.11 本章小结第57-58页
5 仿真与试验讨论第58-64页
 5.1 MATLAB仿真试验第58-60页
  5.1.1 MATLAB简介第58页
  5.1.2 MATLAB仿真试验第58-60页
 5.2 结论第60-62页
 5.3 进一步探讨第62-63页
  5.3.1 关于调制方式第62页
  5.3.2 关于滤波器第62-63页
 5.4 本章小结第63-64页
致谢第64-65页
参考文献第65-67页
附:1、作者在攻读硕士学位期间发表的论著目录第67-68页
2、 作者在攻读硕士学位期间参加的科研项目及得奖情况第68页

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