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基于FPGA平台的众核处理器验证系统研究与实现

摘要第4-5页
Abstract第5页
第一章 绪论第8-14页
    1.1 研究背景与意义第8-10页
    1.2 国内外研究现状与发展第10-12页
        1.2.1 国内x86架构处理器的研究现状第10-11页
        1.2.2 国内外众核处理器发展现状第11页
        1.2.3 国内外芯片验证技术研究进展第11-12页
    1.3 本文主要研究内容第12-14页
第二章 X86众核处理器与验证系统第14-30页
    2.1 x86众核处理器设计第14-19页
        2.1.1 x86处理器概述第14-15页
        2.1.2 x86众核处理器结构第15-17页
        2.1.3 x86众核处理器验证目标第17-19页
    2.2 芯片验证技术第19-22页
        2.2.1 芯片验证方法第19-21页
        2.2.2 芯片验证关键技术第21-22页
    2.3 本文x86众核验证系统介绍第22-28页
        2.3.1 本文验证系统概述第22-23页
        2.3.2 本文验证系统关键技术第23-26页
        2.3.3 本文验证系统设计特点第26-28页
    2.4 本章小结第28-30页
第三章 FPGA验证系统的硬件设计第30-48页
    3.1 验证系统需求分析第30-32页
        3.1.1 验证系统整体需求第30页
        3.1.2 验证系统外设接口需求第30-31页
        3.1.3 验证系统性能需求分析第31-32页
    3.2 验证系统硬件原理设计第32-38页
        3.2.1 整体设计方案第32-33页
        3.2.2 FPGA选型方案设计第33-34页
        3.2.3 FPGA与PC主板交互方案设计第34-35页
        3.2.4 电源方案设计第35-37页
        3.2.5 FPGA验证系统的原理设计第37-38页
    3.3 FPGA验证系统硬件PCB设计第38-43页
        3.3.1 PCB板卡的结构设计第39页
        3.3.2 PCB板卡的布局设计第39-40页
        3.3.3 PCB板卡的布线设计第40-43页
    3.4 FPGA验证系统硬件仿真第43-46页
    3.5 本章小结第46-48页
第四章 FPGA验证系统的软件设计第48-62页
    4.1 PCI Express的控制器设计第48-52页
        4.1.1 PCI Express架构设计第48-49页
        4.1.2 PCI Express控制器的实现第49-52页
    4.2 DDR3的控制器设计第52-56页
        4.2.1 DDR3架构设计第52-53页
        4.2.2 DDR3控制器的实现第53-56页
    4.3 PCI Express驱动程序设计第56-60页
        4.3.1 PCI Express设备访存原理第56-57页
        4.3.2 PCI Express配置空间和地址映射第57页
        4.3.3 Linux环境下驱动程序设计第57-60页
    4.4 本章小结第60-62页
第五章 验证系统测试与x86众核验证第62-74页
    5.1 验证系统的电气特性测试第62-64页
        5.1.1 系统的阻抗测试第62-63页
        5.1.2 系统的电压测试第63页
        5.1.3 系统的时钟测试第63-64页
        5.1.4 系统的复位测试第64页
    5.2 验证系统的接口功能测试第64-68页
        5.2.1 系统的串口测试第64-65页
        5.2.2 系统的USB测试第65-66页
        5.2.3 系统的DDR3测试第66-67页
        5.2.4 系统的PCIe测试第67-68页
    5.3 x86指令集众核结构验证第68-73页
        5.3.1 x86众核单个节点功能验证第68-70页
        5.3.2 多个x86小核Mesh网络结构验证第70-73页
    5.4 本章小结第73-74页
第六章 结论与展望第74-76页
    6.1 全文总结第74页
    6.2 未来展望第74-76页
参考文献第76-78页
致谢第78-80页
个人简历、在学期间发表的论文与研究成果第80页

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