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面向数字信号处理的自修复可重构阵列研究

摘要第4-5页
ABSTRACT第5-6页
注释表第12-13页
第一章 绪论第13-22页
    1.1 课题的研究背景与意义第13-14页
    1.2 数字信号处理实现技术现状第14-15页
    1.3 容错技术研究现状第15-19页
        1.3.1 基于配置数据重载的容错技术第15-16页
        1.3.2 基于备份冗余的容错技术第16页
        1.3.3 基于外部控制器实现重构的容错技术第16-18页
        1.3.4 分布式自主容错技术第18-19页
    1.4 本文主要研究工作与内容安排第19-22页
        1.4.1 本文的主要研究工作第19-20页
        1.4.2 本文的内容安排第20-22页
第二章 常用的数字信号处理算法硬件实现方案分析第22-30页
    2.1 常用数字信号处理算法介绍第22-24页
        2.1.1 卷积第22页
        2.1.2 相关第22-23页
        2.1.3 数字滤波器第23页
        2.1.4 离散傅里叶变换(DFT)第23-24页
        2.1.5 离散小波变换(DWT)第24页
    2.2 常用数字信号处理算法硬件实现分析第24-29页
        2.2.1 加法运算第25-28页
            2.2.1.1 基于二叉树的实现方法第25-26页
            2.2.1.2 基于 Wallace 树的实现方法第26-27页
            2.2.1.3 基于查找表的实现方法第27-28页
        2.2.2 乘法运算第28-29页
            2.2.2.1 移位相加乘法器第28页
            2.2.2.2 加法器树乘法器第28-29页
            2.2.2.3 查找表乘法器第29页
    2.3 本章小结第29-30页
第三章 面向数字信号处理的自修复可重构阵列结构设计第30-43页
    3.1 引言第30-31页
    3.2 可重构阵列体系结构第31页
    3.3 可重构阵列细胞单元结构第31-40页
        3.3.1 控制模块结构第32-33页
        3.3.2 配置存储器结构第33-35页
        3.3.3 可重构阵列功能模块结构第35-40页
            3.3.3.1 常系数乘法单元第35-37页
            3.3.3.2 可配置逻辑单元第37-38页
            3.3.3.3 功能模块整体结构与配置第38-40页
    3.4 可重构阵列重布线开关块第40-42页
    3.5 本章小结第42-43页
第四章 应用实例设计与仿真结果分析第43-55页
    4.1 FIR 滤波器实现结构分析第43-47页
    4.2 FIR 滤波器参数设计第47-48页
        4.2.1 FIR 滤波器性能指标确定第47页
        4.2.2 FIR 滤波器系数提取与量化第47-48页
    4.3 基于自修复可重构阵列的 FIR 滤波器映射实例及仿真第48-53页
        4.3.1 基于自修复可重构阵列的 FIR 滤波器映射实例第49-50页
        4.3.2 基于自修复可重构阵列的 FIR 滤波器功能仿真及容错验证第50-53页
    4.4 容错性能分析第53-54页
    4.5 本章小结第54-55页
第五章 实验电路设计与结果分析第55-72页
    5.1 实验系统总体设计第55-56页
    5.2 高速 ADDA 转换电路第56-62页
        5.2.1 模数转换模块第56-59页
        5.2.2 数模转换模块第59-62页
        5.2.3 电源模块第62页
    5.3 可重构阵列实验电路第62-69页
        5.3.1 可重构阵列实验电路结构第63-67页
        5.3.2 可重构阵列实验电路配置第67页
        5.3.3 可重构阵列实验电路的时钟同步第67-69页
    5.4 实验验证与结果分析第69-71页
    5.5 本章小结第71-72页
第六章 总结与展望第72-74页
    6.1 研究工作总结第72-73页
    6.2 后续研究建议第73-74页
参考文献第74-79页
致谢第79-80页
在学期间的研究成果及发表的学术论文第80页

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