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基于FPGA+DSP的基带数字信号处理平台的研究与实现

摘要第5-6页
ABSTRACT第6-7页
缩略词表第14-15页
第一章 绪论第15-19页
    1.1 数字信号处理系统的发展历史第15-16页
    1.2 数字信号处理系统的发展现状与趋势第16-17页
        1.2.1 数字信号处理器的发展现状第16页
        1.2.2 数字信号处理器的发展趋势第16-17页
    1.3 本文的研究意义第17页
    1.4 研究内容与结构安排第17-19页
        1.4.1 研究内容第17-18页
        1.4.2 论文结构安排第18-19页
第二章 硬件平台与开发环境第19-28页
    2.1 基于SRIO的硬件系统框架第19-20页
    2.2 AD与DA硬件介绍第20-21页
        2.2.1 ADS4229硬件结构第20-21页
        2.2.2 DAC3152硬件结构第21页
    2.3 TSW1400及C6678处理器介绍第21-24页
        2.3.1 TSW1400结构框架第21-23页
        2.3.2 C6678处理器架构第23-24页
    2.4 Quartus II及CCSv5开发环境介绍第24-27页
        2.4.1 Altera系列FPGA开发环境Quartus II介绍第24-26页
        2.4.2 DSP开发环境CCSv5介绍第26-27页
    2.5 本章小结第27-28页
第三章 FPGA与DSP的SRIO系统互连第28-55页
    3.1 RapidIO总线第28-34页
        3.1.1 RapidIO协议拓扑结构第29-30页
        3.1.2 SRIO数据传输第30-32页
        3.1.3 SRIO数据包格式第32-33页
        3.1.4 SRIO时钟域分布第33-34页
    3.2 Doorbell中断第34-35页
    3.3 高速转接板设计第35-36页
    3.4 FPGA端SRIO软件配置第36-43页
        3.4.1 FPGA端系统设计第36-39页
        3.4.2 FPGA端RapidIO IPcore配置第39-42页
        3.4.3 SOPC下系统互连第42-43页
    3.5 DSP端SRIO软件配置第43-45页
    3.6 FPGA与DSP的连接测试第45-54页
        3.6.1 系统上电LINK测试第45-49页
            3.6.1.1 LINK测试步骤第45-48页
            3.6.1.2 LINK测试心得第48-49页
        3.6.2 SRIO读写测试第49-53页
            3.6.2.1 NWRITE测试第49-52页
            3.6.2.2 NREAD测试第52-53页
            3.6.2.3 SRIO读写测试心得第53页
        3.6.3 Doorbell测试第53-54页
    3.7 本章小结第54-55页
第四章 系统的设计与实现第55-73页
    4.1 AD+FPGA+DA系统设计与实现第55-64页
        4.1.1 ALTDDIO_RX模块第55-58页
        4.1.2 ALTDDIO_TX模块第58-59页
        4.1.3 跨时钟域处理第59页
        4.1.4 RX_TO_TX_FIFO模块第59-60页
        4.1.5 系统测试结果第60-64页
            4.1.5.1 直通测试第60-62页
            4.1.5.2 AM调制解调测试第62-64页
    4.2 AD+FPGA+DSP+DA系统设计与实现第64-70页
        4.2.1 乒乓操作第64-65页
        4.2.2 数据采集系统与SOPC系统接第65-66页
        4.2.3 系统测试结果第66-70页
    4.3 C6678多核应用第70-72页
        4.3.1 数据处理模型第70-71页
        4.3.2 核间通信IPC第71-72页
    4.4 本章小结第72-73页
第五章 总结与展望第73-75页
    5.1 本文主要工作第73页
    5.2 工作展望第73-75页
致谢第75-76页
参考文献第76-78页
攻读硕士学位期间取得的成果第78-79页

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