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雷达中频转发模拟器的设计与实现

摘要第3-4页
Abstract第4页
1 绪论第8-12页
    1.1 研究背景及意义第8页
    1.2 研究现状和发展第8-10页
    1.3 论文研究内容和结构安排第10-12页
2 中频转发模拟器的实现流程仿真第12-34页
    2.1 引言第12页
    2.2 中频转发模拟器的任务需求第12-14页
    2.3 中频转发模拟器三个模式的工作流程第14-16页
    2.4 目标中频回波模型建立第16-18页
    2.5 雷达回波转发的中频处理实现第18-33页
        2.5.1 多速率信号采样第19-20页
        2.5.2 数字下变频和FIR滤波器的实现第20-24页
        2.5.3 整数倍抽取和内插第24-26页
        2.5.4 单边带调制信号的处理第26-28页
        2.5.5 目标时延和多普勒的复数域实现第28-29页
        2.5.6 雷达回波和差通道加权第29-30页
        2.5.7 仿真结果分析与验证第30-33页
    2.6 本章小结第33-34页
3 雷达中频转发模拟器的硬件设计第34-46页
    3.1 引言第34页
    3.2 硬件平台搭建第34-37页
        3.2.1 硬件方案需求第34-35页
        3.2.2 板卡方案设计第35-37页
    3.3 关键技术问题解决和实现第37-44页
        3.3.1 电源模块设计第37-41页
        3.3.2 时钟模块设计第41-42页
        3.3.3 高速信号线处理第42-43页
        3.3.4 模拟地和数字地分割第43-44页
    3.4 PCB设计与实现第44-45页
    3.5 本章小结第45-46页
4 雷达中频转发模拟器的软件设计第46-62页
    4.1 引言第46页
    4.2 软件整体设计和任务划分第46-47页
    4.3 千兆以太网口程序设计第47-51页
        4.3.1 嵌入式三态以太网口硬核第48-49页
        4.3.2 千兆网口传输信息及协议规定第49-50页
        4.3.3 数据传输验证与实现第50-51页
    4.4 嵌入式处理器PowerPC总体设计第51-57页
        4.4.1 嵌入式处理器PowerPC硬核及EDK定制第52-53页
        4.4.2 软件开发套件SDK中任务分配与设计第53-54页
        4.4.3 加权查表法设计及流程第54-55页
        4.4.4 目标航迹计算及SDK程序实现第55-57页
    4.5 硬件描述语言程序设计和资源误差分析第57-61页
        4.5.1 硬件描述语言Verilog-HDL的总体设计第58-59页
        4.5.2 FIR滤波器IP核实现及资源分析第59页
        4.5.3 有限字长效应及误差分析第59-61页
    4.6 本章小结第61-62页
5 工控机侧显示界面功能实现第62-66页
    5.1 引言第62页
    5.2 基于千兆网口的整体界面设计第62-65页
        5.2.1 基本波形测试模式第63-64页
        5.2.2 计算机下载任意波形并转发模式第64页
        5.2.3 实时采集雷达中频泄露信号并转发模式第64-65页
    5.3 本章小结第65-66页
6 总体调试分析与结果验证第66-72页
    6.1 引言第66页
    6.2 硬件功能模块测试第66-69页
        6.2.1 ADC动态有效位测试第66-67页
        6.2.2 DAC无杂散动态范围测试第67-68页
        6.2.3 双端口SRAM功能测试第68-69页
        6.2.4 存储FLASH功能测试第69页
    6.3 总体功能实现结果和分析第69-71页
    6.4 本章小结第71-72页
7 总结与展望第72-74页
致谢第74-75页
参考文献第75-77页

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