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可编程逻辑器件在光纤局域网中的应用

前言第1-23页
第一章 可编程逻辑器件概述第23-42页
 1.1 可编程逻辑器件的发展历程第23-25页
 1.2 ASIC、FPGA/CPLD技术第25-28页
  1.2.1 ASIC技术第25-27页
  1.2.2 FPGA/CPLD技术第27-28页
 1.3 ALTERA可编程逻辑器件简介第28-34页
  1.3.1 ALTERA FLEX 10KE/ACEX 1K功能结构描述第29-31页
  1.3.2 ALTERA FLEX 10KE/ACEX 1K器件特点第31-34页
 1.4 可编程逻辑器件的开发设计第34-39页
  1.4.1 可编程逻辑器件开发平台第34-35页
  1.4.2 可编程逻辑器件的设计方法第35-37页
  1.4.3 可编程逻辑器件的设计语言——VHDL语言第37-39页
 1.5 采用可编程逻辑器件制造专用通信芯片的必要性第39-42页
第二章 高速铁路安全信息光纤局域网第42-60页
 2.1 计算机局域网概述第42-45页
 2.2 网络拓扑结构第45-48页
  2.2.1 星型拓扑第45-46页
  2.2.2 总线拓扑第46-47页
  2.2.3 环形拓扑第47页
  2.2.4 树型拓扑第47-48页
 2.3 网络的介质访问控制方法第48-53页
  2.3.1 争用方法第49页
  2.3.2 标记环介质访问控制第49-50页
  2.3.3 时间片分割环访问控制第50-51页
  2.3.4 寄存器插入环访问控制第51-52页
  2.3.5 时分多重访问介质访问控制(TDMA)第52页
  2.3.6 位映象介质访问控制(BIT-MAP)第52-53页
 2.4 高速铁路信号安全信息光纤局域网第53-60页
  2.4.1 高速铁路安全信息光纤局域网的拓扑结构第55-58页
  2.4.2 高速铁路安全信息光纤局域网的介质访问控制方法第58-60页
第三章 高速铁路安全信息光纤局域网节点通信协议及其分析第60-75页
 3.1 数据通信协议第60-68页
  3.1.1 地址第61页
  3.1.2 主站帧格式第61-63页
  3.1.3 从站帧格式第63页
  3.1.4 链路结构第63-64页
  3.1.5 链路协议的传输控制第64页
  3.1.6 传输差错控制第64-66页
  3.1.7 网络状态的管理第66页
  3.1.8 主备倒换控制第66-68页
 3.2 网络节点设备协议流程分析第68-75页
第四章 光纤局域网网络节点设备的硬件实现第75-91页
 4.1 网络节点设备的技术要求第75-77页
 4.2 网络节点设备的硬件结构第77-86页
  4.2.1 传统光纤局域网网络节点设备的硬件结构第77-78页
  4.2.2 专用通信芯片的实现第78-83页
  4.2.3 ISA总线第83-86页
 4.3 网络节点设备的通信方式第86-88页
  4.3.1 主站网络节点设备与PC机的通信第87页
  4.3.2 从站网络节点设备与PC机的通信第87-88页
 4.4 专用通信芯片的引脚分配及注意事项第88-91页
第五章 光纤局域网专用通信芯片的模块化设计第91-111页
 5.1 专用通信芯片的设计第91-95页
  5.1.1 专用通信芯片的设计方法第91-93页
  5.1.2 专用通信芯片的层次化设计及功能模块划分第93-95页
 5.2 专用通信芯片的功能模块设计及软件仿真第95-108页
  5.2.1 CRC校验模块第95-97页
  5.2.2 串并变换模块第97-99页
  5.2.3 并串变换模块第99-100页
  5.2.4 帧检测模块第100-102页
  5.2.5 RAM读写数据模块第102-106页
  5.2.6 主站控制模块第106-108页
 5.3 专用通信芯片VHDL程序的配置与下载第108-109页
 5.4 硬件试验及结论第109-111页
参考文献第111-113页

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