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基于HEVC的视频编码算法及硬件体系结构研究

摘要第4-6页
ABSTRACT第6-8页
第1章 绪论第15-42页
    1.1 课题背景与研究意义第15-22页
        1.1.1 视频编码技术发展及应用第15-16页
        1.1.2 视频编码技术面临的问题与挑战第16-19页
        1.1.3 视频编码技术历史第19-20页
        1.1.4 HEVC编码技术特征第20-22页
    1.2 视频编码原理与优化第22-26页
        1.2.1 视频编码基本原理第22-24页
        1.2.2 视频编码优化原理第24-26页
    1.3 国内外研究现状第26-38页
        1.3.1 帧内预测优化技术第26-30页
        1.3.2 帧间运动估计技术第30-35页
        1.3.3 视频编码电路结构设计第35-38页
    1.4 论文的主要研究内容第38-42页
第2章 基于编码块纹理特征的帧内预测算法优化第42-64页
    2.1 引言第42页
    2.2 HEVC帧内预测过程分析第42-47页
        2.2.1 编码单元CU帧内预测过程分析第42-45页
        2.2.2 HEVC帧内预测模式选择分析第45-47页
    2.3 基于编码块纹理特性的HEVC帧内预测模式选择算法第47-54页
        2.3.1 基于编码块SDG参数的HEVC帧内模式选择算法第47-53页
        2.3.2 基于编码块SDG帧内预测优化算法测试与分析第53-54页
    2.4 基于方向梯度的HEVC纹理模式预选算法第54-57页
        2.4.1 编码块G-SAD参数与纹理模式分析第54-55页
        2.4.2 基于编码块G-SAD纹理模式预选算法第55-57页
        2.4.3 基于编码块G-SAD帧内预测优化算法测试第57页
    2.5 算法联合验证与比较分析第57-60页
    2.6 基于宏块SDG参数的H.264 帧内预测优化算法第60-63页
    2.7 本章小结第63-64页
第3章 帧内/帧间模式判决优化及硬件电路设计第64-82页
    3.1 引言第64页
    3.2 视频编码器帧内/帧间判决过程第64-67页
        3.2.1 帧内/帧间判决函数第64-66页
        3.2.2 帧内/帧间判决过程第66-67页
    3.3 HEVC编码单元CU帧内/帧间判决优化第67-75页
        3.3.1 帧内预测与帧间预测代价比较第69-71页
        3.3.2 基于CU单元像素相关度的帧内/帧间预判决算法第71-72页
        3.3.3 算法验证与比较分析第72-73页
        3.3.4 帧内/帧间判决算法H.264 移植与验证第73-75页
    3.4 视频编码优化算法VLSI实现第75-81页
        3.4.1 算法VLSI实现第76-80页
        3.4.2 电路综合与比较分析第80-81页
    3.5 本章小结第81-82页
第4章 帧间运动估计算法电路结构设计第82-98页
    4.1 引言第82页
    4.2 运动估计算法的并行处理研究第82-88页
        4.2.1 HEVC运动估计并行性分析第82-84页
        4.2.2 相邻编码块运动向量相关特性第84-86页
        4.2.3 HEVC运动估计算法并行优化第86-87页
        4.2.4 并行运动估计算法测试第87-88页
    4.3 自适应搜索范围调整算法第88-93页
        4.3.1 运动矢量预测分析第89-90页
        4.3.2 搜索中心匹配残差与搜索范围关系第90-92页
        4.3.3 基于匹配误差的自适应搜索范围调整算法第92-93页
        4.3.4 搜索范围调整算法测试第93页
    4.4 运动估计算法联合验证与比较分析第93-97页
    4.5 本章小结第97-98页
第5章 运动估计算法硬件体系结构设计第98-115页
    5.1 引言第98页
    5.2 硬件电路结构设计第98-106页
        5.2.1 运动估计电路结构设计第98-99页
        5.2.2 运动估计电路结构第99-106页
    5.3 参考帧数据存储系统设计第106-112页
        5.3.1 参考帧数据复用分析第107-108页
        5.3.2 参考帧图像数据存储策略第108-111页
        5.3.3 1-D脉动阵列输入寄存器设计第111页
        5.3.4 1-D脉动阵列核心时序分析第111-112页
    5.4 运动估计单元电路综合与对比分析第112-114页
    5.5 本章小结第114-115页
结论第115-117页
参考文献第117-127页
攻读博士学位期间发表的论文及其他成果第127-130页
致谢第130-131页
个人简历第131页

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