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面向Sub-GHz无线通信技术的低功耗小数分频频率综合器设计

致谢第4-5页
摘要第5-6页
Abstract第6-7页
1 绪论第15-20页
    1.1 论文研究背景及意义第15-17页
    1.2 国内外研究现状分析第17-18页
        1.2.1 频率综合器国外发展动态第17页
        1.2.2 频率综合器国内发展动态第17-18页
        1.2.3 频率综合器未来发展趋势第18页
    1.3 论文的组织结构第18-20页
2 频率综合器概述第20-42页
    2.1 频率综合器简述第20页
    2.2 锁相环型频率综合器的系统结构第20-23页
        2.2.1 整数分频频率综合器第20-22页
        2.2.2 小数分频频率综合器第22页
        2.2.3 全数字锁相环型频率综合器第22-23页
    2.3 锁相环型频率综合器的核心电路模块第23-36页
        2.3.1 鉴频鉴相器和电荷泵第23-25页
        2.3.2 环路滤波器第25-26页
        2.3.3 压控振荡器第26-31页
        2.3.4 分频器第31-34页
        2.3.5 Delta-Sigma调制器第34-36页
    2.4 频率综合器的性能指标第36-38页
        2.4.1 相位噪声第36-37页
        2.4.2 调谐范围第37页
        2.4.3 杂散第37页
        2.4.4 频率步进第37-38页
        2.4.5 锁定时间第38页
    2.5 频率综合器的环路分析第38-41页
        2.5.1 频率综合器环路分析第38-39页
        2.5.2 频率综合器相位噪声分析第39-41页
    2.6 本章小结第41-42页
3 电路模块设计方法第42-68页
    3.1 鉴频鉴相器的设计方法第42-44页
    3.2 电荷泵的设计方法第44-48页
    3.3 环路滤波器的设计方法第48-51页
    3.4 压控振荡器的设计方法第51-56页
    3.5 分频器的设计方法第56-59页
    3.6 Delta-Sigma调制器的设计方法第59-63页
    3.7 自动频率校准算法第63-66页
    3.8 本章小结第66-68页
4 Sub-GHz频率综合器的设计与实现第68-85页
    4.1 Sub-GHz频率综合器的研究背景第68-69页
    4.2 Sub-GHz频率综合器的系统设计第69-70页
    4.3 Sub-GHz频率综合器的模块设计第70-80页
        4.3.1 鉴频鉴相器第70-71页
        4.3.2 电荷泵第71-72页
        4.3.3 宽带压控振荡器第72-76页
        4.3.4 多模分频器第76页
        4.3.5 环路滤波器和系统环路仿真第76-78页
        4.3.6 版图设计与实现第78-80页
    4.4 Sub-GHz频率综合器的测试结果第80-84页
        4.4.1 PCB电路板设计第80页
        4.4.2 芯片封装第80-81页
        4.4.3 测试平台搭建第81页
        4.4.4 测试结果和分析第81-84页
    4.5 本章小结第84-85页
5 总结与展望第85-87页
    5.1 工作总结第85-86页
    5.2 未来展望第86-87页
参考文献第87-91页
硕士在读期间研究成果第91页

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