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基于IP的计算机图像处理技术的实现

第一章 前言第1-9页
   ·课题研究背景第8页
   ·课题研究目标第8页
   ·课题研究意义第8-9页
第二章 IP 复用技术简介第9-10页
   ·IP 核第9页
   ·IP 模块的重用第9-10页
第三章 图像转化卡的设计和实现第10-28页
   ·图像转换卡框架第10-11页
   ·计算机图像输出接口第11-15页
     ·XVGA第12页
     ·DVI (Digital Visual Interface)数字视频接口第12-14页
     ·VESA 时间标准第14-15页
   ·FPGA 的选取第15-19页
     ·嵌入式存储器TriMatrix:第16页
     ·DSP 块:第16页
     ·高带宽 I/O 标准和高速接口第16-17页
     ·用于系统时钟管理的PLL第17-19页
   ·图像采集芯片的选取第19-20页
   ·图像输出芯片的选取第20-22页
   ·DDR SDRAM第22-23页
   ·图像处理卡的实现第23-28页
第四章 计算机图像处理核心FPGA 的Verilog 设计与实现第28-57页
   ·FPGA 的设计方法和设计规划第28-29页
     ·基于块的设计流程第28页
     ·设计分割第28页
     ·QuatusII 中基于块的设计的实现第28-29页
   ·系统结构分析与建模第29-31页
   ·IP 的HDL 设计与实现第31-57页
     ·图像采集模块第31-34页
       ·基本功能第31页
       ·内部功能块定义第31-33页
       ·Fif0246 功能及特性第33页
       ·InputControl 功能、设计思想及特性第33-34页
     ·图像输出模块第34-39页
       ·基本功能第34-35页
       ·内部功能块定义说明第35-37页
       ·fifo_24_2048_DDR 功能及特性第37页
       ·PPimageOut 的功能,设计思路和特性第37-39页
     ·图像计算模块实例第39-46页
       ·功能说明第39页
       ·实现方法第39-40页
       ·paraTableRead 模块功能及设计思想第40-42页
       ·pixelSelect 模块功能及设计思想第42-45页
       ·ImageMult_Add 模块功能及设计思想第45页
       ·Rimagefifo 模块功能及设计思想第45-46页
     ·DDR SDRAM 操作模块第46-53页
       ·基本功能第46-47页
       ·DDR 器件初始化过程第47-49页
       ·FwriteAline 操作的说明和实现方式第49-51页
       ·FreadAline 操作的说明和实现方式第51-52页
       ·Fread2word 操作的说明和实现方式第52页
       ·共享资源Fdataenable,Fnewframe第52-53页
     ·RamRoll 模块说明第53-55页
       ·基本功能第53页
       ·设计思路第53-55页
     ·bankRoll 模块说明第55-57页
       ·基本功能第55-56页
       ·设计思路第56-57页
第五章 时序分析、软IP 核的生成和系统的综合第57-61页
   ·时序分析第57-58页
   ·软IP 核生成第58-60页
     ·Top-Down vs. Bottom-up第58-59页
     ·利用QuatusII 生成软IP 核第59-60页
   ·系统综合第60-61页
第六章 系统仿真与设计验证第61-66页
   ·测试平台第61-62页
   ·在大视场系统中的应用第62-66页
     ·大视场系统简介第62-63页
     ·大视场系统中图像校正的实现原理第63-65页
       ·图像校正方式简述第63-64页
       ·双线性插值第64-65页
     ·应用结果第65-66页
第七章 结论与展望第66-68页
   ·全文工作总结第66页
   ·未来研究展望第66-68页
参考文献第68-70页
致谢第70-71页

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