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基于UVM的FPGA代码功能验证技术研究

摘要第4-5页
Abstract第5页
第1章 绪论第8-16页
    1.1 课题背景及研究的目的和意义第8-9页
    1.2 国内外研究现状及分析第9-14页
        1.2.1 基于Testbench的验证方法第10-11页
        1.2.2 基于验证方法学的验证第11-14页
    1.3 主要研究内容与目标第14-15页
    1.4 本文结构第15-16页
第2章 UVM验证平台架构分析第16-34页
    2.1 UVM验证平台结构第16-23页
        2.1.1 典型UVM验证平台结构第16-20页
        2.1.2 UVM的工厂机制第20-22页
        2.1.3 验证平台的接口第22-23页
    2.2 UVM验证平台中的TLM通信技术第23-27页
        2.2.1 TLM的基本端口的使用第23-26页
        2.2.2 TLM的仿真加速第26-27页
    2.3 UVM验证平台的运行第27-32页
        2.3.1 phase机制第27-30页
        2.3.2 Objection机制第30-31页
        2.3.3 消息管理机制第31-32页
    2.4 本章小结第32-34页
第3章 UVM验证平台关键模块技术研究第34-60页
    3.1 参考模型设计技术第34-46页
        3.1.1 寄存器模型实现第35-40页
        3.1.2 参考模型的功能设计第40-45页
        3.1.3 参考模型的接口设计第45-46页
    3.2 测试向量设计技术第46-53页
        3.2.1 受约束的随机机制第46-48页
        3.2.2 UVM中的激励的产生第48-53页
    3.3 驱动器和监视器设计技术研究第53-58页
        3.3.1 驱动器设计技术第53-56页
        3.3.2 监视器的设计第56-58页
    3.4 本章小结第58-60页
第4章 基于UVM的CAN逻辑验证第60-81页
    4.1 CAN总线及控制器第60-63页
        4.1.1 CAN总线第60-61页
        4.1.2 CAN控制器逻辑第61-63页
    4.2 验证计划的制定第63-66页
        4.2.1 制定验证功能点第64-65页
        4.2.2 覆盖功能点第65-66页
    4.3 验证平台的搭建第66-75页
        4.3.1 验证平台组件的实现第66-72页
        4.3.2 验证平台的结构第72-75页
    4.4 结果及分析第75-79页
    4.5 本章小结第79-81页
结论第81-83页
参考文献第83-87页
攻读学位期间发表的学术论文及其它成果第87-89页
致谢第89页

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