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基于FPGA的8051单片机IP核设计及应用

摘要第1-5页
ABSTRACT第5-9页
第一章 绪论第9-24页
   ·课题研究背景及意义第9页
   ·FPGA的结构及应用第9-16页
     ·FPGA的结构第10-13页
     ·FPGA设计流程第13-15页
     ·IP核简介第15-16页
   ·8051单片机的结构第16-23页
     ·CPU系统第17页
     ·存储器第17-20页
     ·输入输出口(I/O)第20-21页
     ·串行接口第21页
     ·定时/计数器第21-22页
     ·中断系统第22-23页
   ·论文的组织第23-24页
第二章 FPGA开发平台的硬件设计第24-28页
   ·FPGA开发平台的硬件设计方案第24-25页
   ·FPGA模块第25页
   ·EEPROM模块第25-26页
   ·SRAM模块第26页
   ·键盘模块第26-27页
   ·电源模块第27-28页
第三章 51内核模块及其外围剖析第28-41页
   ·CPU内部结构剖析第28-31页
     ·算术逻辑单元结构第28-29页
     ·控制单元结构第29-31页
   ·外围结构剖析第31-41页
     ·定时/计数器第31-34页
     ·串行接口第34-38页
     ·中断系统内部结构剖析第38-41页
第四章 用VHDL实现8051单片机系统第41-71页
   ·8051单片机系统的逻辑设计第41-43页
   ·CPU的实现第43-55页
     ·ALU模块的实现第44-48页
     ·控制模块的实现第48-50页
     ·程序存储器控制模块的实现第50-52页
     ·数据存储器控制模块的实现第52-55页
   ·定时/计数器模块第55-58页
     ·定时/计数器波特率发生器的实现第56-57页
     ·外部中断检测电路的实现第57-58页
   ·串口模块第58-60页
     ·SCON寄存器的实现第58页
     ·各模式对应波特率的实现第58-59页
     ·接收采样电路的实现第59-60页
   ·中断服务模块的实现第60-64页
     ·中断屏蔽的实现第62页
     ·中断优先级的实现第62页
     ·中断请求信号的实现第62页
     ·自然优先级的生成第62-64页
   ·同步复位模块的实现第64-65页
   ·输入/输出端口模块的实现第65-67页
     ·P0o、P2o的实现第66页
     ·P3o的实现第66-67页
   ·数据存储器的实现第67-68页
   ·8051单片机系统的整体实现第68-71页
第五章 8051MCUIP核的应用第71-77页
   ·键盘工作原理第71-74页
     ·键盘工作方式第72页
     ·键输入过程第72-73页
     ·键盘输入接口与软件应解决的任务第73-74页
   ·键盘识别的实现过程第74-76页
     ·程序设计内容第74页
     ·程序设计及实现第74-76页
   ·FPGA工作过程第76-77页
第六章 总结与展望第77-78页
附录1第78-79页
附录2第79-80页
附录3 指令集仿真图第80-123页
参考文献第123-125页
致谢第125-126页
攻读硕士学位期间发表的学术论文第126页

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