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MP3解码电路的IC设计

致谢第5-6页
摘要第6-7页
ABSTRACT第7页
1 引言第11-17页
    1.1 研究背景及意义第11-13页
    1.2 国内外研究现状第13-15页
    1.3 研究内容和论文的组织结构第15-17页
2 MP3解码基本原理第17-31页
    2.1 音频压缩原理第17-18页
    2.2 MPEG1 LAYER3音频标准简介第18页
    2.3 MP3解码流程第18-30页
        2.3.1 MP3码流格式第19-23页
        2.3.2 帧头解码第23-24页
        2.3.3 Huffman解码第24-25页
        2.3.4 反量化第25-26页
        2.3.5 重排序第26页
        2.3.6 立体声处理第26-27页
        2.3.7 混叠重建第27页
        2.3.8 IMDCT第27-29页
        2.3.9 频率翻转与子带综合滤波第29-30页
    2.4 本章小结第30-31页
3 快速算法的VERILOG实现与仿真第31-61页
    3.1 MP3解码整体架构第31-32页
    3.2 帧头解码第32-36页
    3.3 霍夫曼解码第36-42页
        3.3.1 霍夫曼解码实现方式第36-38页
        3.3.2 霍夫曼解码模块结构第38-41页
        3.3.3 霍夫曼解码结果对比第41-42页
    3.4 反量化第42-48页
        3.4.1 反量化的实现方式第42-44页
        3.4.2 反量化的模块结构第44-47页
        3.4.3 反量化的结果对比第47-48页
    3.5 立体声处理第48-49页
        3.5.1 立体声处理的实现方式第48页
        3.5.2 立体声处理的结构第48-49页
        3.5.3 立体声处理的结果对比第49页
    3.6 混叠重建第49-51页
    3.7 IMDCT第51-54页
        3.7.1 IMDCT的实现方式第51-52页
        3.7.2 IMDCT的模块结构第52-53页
        3.7.3 IMDCT的结果对比第53-54页
    3.8 子带综合滤波第54-61页
        3.8.1 子带综合滤波的实现方式第54-55页
        3.8.2 子带综合滤波的模块结构第55-58页
        3.8.3 子带综合滤波的结果对比第58-61页
4 FPGA验证第61-73页
    4.1 DE2-115开发板介绍第61-62页
    4.2 FPGA验证架构第62-63页
    4.3 WM8731音频解码芯片及其配置第63-67页
        4.3.1 WM8731接口及工作原理第63-66页
        4.3.2 音频控制模块的Velog HDL设计第66-67页
    4.4 I2C总线及其配置第67-69页
        4.4.1 I2C总线工作原理第67-68页
        4.4.2 I2C控制模块的verilog设计第68-69页
    4.5 FPGA验证结果及结论第69-73页
5 MP3解码电路的VLSI实现第73-89页
    5.1 数字集成电路设计流程第73页
    5.2 逻辑综合第73-78页
        5.2.1 时序约束第74-76页
        5.2.2 面积约束第76页
        5.2.3 环境约束第76-77页
        5.2.4 其他脚本内容第77页
        5.2.5 综合结果第77-78页
    5.3 布局布线前STA第78-79页
    5.4 物理设计第79-86页
        5.4.1 读入设计第80页
        5.4.2 布图规划第80-81页
        5.4.3 电源规划第81-83页
        5.4.4 标准单元放置第83页
        5.4.5 时钟树综合及优化第83-85页
        5.4.6 布线及优化第85-86页
        5.4.7 版图验证第86页
        5.4.8 相关文件导出第86页
    5.5 布局布线后STA第86-87页
    5.6 物理验证第87-88页
    5.7 本章小结第88-89页
6 低功耗设计第89-95页
    6.1 工艺库功耗模型第89页
    6.2 功耗的分析第89-90页
    6.3 低功耗电路的设计和优化第90-92页
        6.3.1 门控时钟电路第90页
        6.3.2 操作数分离第90-92页
        6.3.3 多个供电电压第92页
    6.4 低功耗设计结果第92-95页
7 结论第95-97页
    7.1 论文总结第95页
    7.2 论文展望第95-97页
参考文献第97-101页
作者简历及攻读硕士学位期间取得的研究成果第101-105页
学位论文数据集第105页

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