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TIADC系统时钟失配误差校正算法研究

摘要第4-6页
ABSTRACT第6-7页
第一章 绪论第15-21页
    1.1 概述第15-16页
    1.2 研究背景与意义第16-19页
        1.2.1 时间交替采样技术的发展概况第16-18页
        1.2.2 TIADC失配误差校正技术发展现状第18-19页
        1.2.3 课题的研究意义第19页
    1.3 课题研究的主要内容第19-21页
第二章 TIADC系统的原理及误差分析第21-33页
    2.1 引言第21页
    2.2 理想TIADC系统的基本原理第21-23页
    2.3 TIADC系统通道失配误差的理论分析第23-27页
        2.3.1 失配误差的建模第23-24页
        2.3.2 失配误差的分析第24-27页
    2.4 TIADC系统通道失配误差的仿真验证第27-32页
        2.4.1 偏置误差第27-28页
        2.4.2 增益误差第28-30页
        2.4.3 时钟失配误差第30-31页
        2.4.4 三种失配误差第31-32页
    2.5 本章小结第32-33页
第三章 TIADC系统时钟失配误差校正算法研究第33-49页
    3.1 引言第33页
    3.2 基于正弦拟合的通道失配误差估算第33-36页
        3.2.1 正弦拟合估算法第33-34页
        3.2.2 估算效果仿真第34-36页
    3.3 基于完美重构的校正滤波器设计第36-44页
        3.3.1 完美重构校正原理第36-38页
        3.3.2 校正滤波器组的设计与仿真第38-41页
        3.3.3 校正滤波器组的改善与验证第41-44页
    3.4 基于完美重构的全并行校正结构第44-48页
        3.4.1 多通道滤波器组的实现方法第44-46页
        3.4.2 基于完美重构的全并行实现方法第46-48页
    3.5 本章小结第48-49页
第四章 TIADC系统误差校正电路的设计与实现第49-63页
    4.1 引言第49页
    4.2 电路参数设置第49页
    4.3 总体方案设计第49-52页
    4.4 校正电路各模块的FPGA设计第52-61页
        4.4.1 数据缓存模块的设计第52-53页
        4.4.2 串并转换模块设计第53-55页
        4.4.3 误差校正模块的设计第55-60页
        4.4.4 数据合路模块的设计第60-61页
    4.5 本章小结第61-63页
第五章 系统仿真、验证与分析第63-71页
    5.1 引言第63页
    5.2 系统仿真与验证方案设计第63-64页
        5.2.1 仿真验证方案设计第63页
        5.2.2 仿真验证平台设计第63-64页
    5.3 仿真结果与分析第64-69页
        5.3.1 ModelSim仿真结果分析第64-66页
        5.3.2 MATLAB性能分析第66-68页
        5.3.3 电路综合报告第68-69页
    5.4 本章小结第69-71页
第六章 结论与展望第71-73页
    6.1 结论第71页
    6.2 展望第71-73页
参考文献第73-77页
致谢第77-79页
研究成果及发表的学术论文第79-81页
作者和导师简介第81-82页
附件第82-83页

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