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H.264帧内编码算法的硬件并行化设计

摘要第5-6页
ABSTRACT第6-7页
缩略语对照表第11-14页
第一章 绪论第14-22页
    1.1 论文研究背景第14-15页
    1.2 国内外研究现状第15-19页
    1.3 论文的研究内容及安排第19-22页
第二章 算法硬件化方法研究第22-32页
    2.1 算法硬件化第22-26页
        2.1.1 传统算法硬件化方法介绍第22-24页
        2.1.2 基于高级语言的算法硬件化第24-26页
    2.2 高级算法硬件化语言HANDEL-C第26-30页
        2.2.1 Handel-C语言的特性第26-27页
        2.2.2 Handel-C语言的算法硬件化开发方法第27-29页
        2.2.3 Handel-C开发环境介绍第29-30页
    2.3 本章小结第30-32页
第三章 H.264帧内编码算法分析与方案设计第32-46页
    3.1 H.264编码器结构第32-34页
    3.2 H.264帧内编码算法分析第34-43页
        3.2.1 变换模块第34-36页
        3.2.2 量化模块第36-38页
        3.2.3 熵编码模块第38-43页
    3.3 H.264帧内编码算法硬件化方案设计第43-44页
    3.4 本章小结第44-46页
第四章 基于HANDEL-C的H.264帧内编码硬件化实现第46-60页
    4.1 变换模块的并行化设计与实现第46-50页
        4.1.1 变换算法的优化和模块设计第46-48页
        4.1.2 变换模块的并行化实现第48-49页
        4.1.3 变换模块的仿真验证第49-50页
    4.2 量化模块的实现第50-53页
        4.2.1 量化模块的设计与实现第50-52页
        4.2.2 量化模块的仿真验证第52-53页
    4.3 CAVLC模块的实现第53-58页
        4.3.1 CAVLC模块的设计与实现第53-56页
        4.3.2 CAVLC模块的仿真验证第56-58页
    4.4 本章小结第58-60页
第五章 基于DE1-SOC的H.264算法验证第60-72页
    5.1 验证平台第60-64页
    5.2 算法验证方案第64-69页
    5.3 算法验证第69-71页
    5.4 本章小结第71-72页
第六章 总结与展望第72-74页
    6.1 总结第72页
    6.2 展望第72-74页
参考文献第74-76页
致谢第76-78页
作者简介第78-79页

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