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CMOS ΣΔ分数频率综合器的若干关键技术研究

摘要第1-6页
Abstract第6-14页
第1章 引言第14-18页
   ·论文的研究背景第14页
   ·频率综合器的定义和分类第14-15页
   ·收发信机中的频率综合器第15-16页
   ·论文的主要贡献第16-17页
   ·论文各部分的主要内容第17-18页
第2章 ΣΔ分数锁相环频率综合器的系统级设计和考虑第18-31页
   ·分数锁相环频率综合器的结构选择第18-19页
   ·ΣΔ分数锁相环频率综合器的基本原理第19-20页
   ·环路参数选择第20-22页
   ·模块电路选择第22-27页
     ·ΣΔ调制器第22-23页
     ·鉴相鉴频器第23页
     ·电荷泵第23-25页
     ·预分频器和环路滤波器第25-26页
     ·VCO第26-27页
   ·性能参数考虑第27-30页
     ·杂散第27页
     ·量化噪声第27-28页
     ·带内相位噪声第28-29页
     ·带外相位噪声第29页
     ·精度和分辨率第29-30页
   ·小结第30-31页
第3章 ΣΔ分数锁相环频率综合器的行为级建模和仿真第31-46页
   ·抖动和杂散第32-33页
   ·混合仿真流程和策略第33-35页
   ·基于VERIOGA/VERILOG 的电路模型设计第35-42页
     ·OSC 模型第35-36页
     ·鉴相鉴频器模型第36-37页
     ·电荷泵模型第37-38页
     ·VCO/分频器模型第38-40页
     ·ΣΔ调制器和倍频器模型第40-42页
   ·仿真和测试结果第42-45页
   ·小结第45-46页
第4章 一个基于PHS 应用的分数频率综合器设计和实现第46-72页
   ·系统结构第46-47页
   ·VCO第47-49页
   ·分频器第49-52页
     ·系统结构第49-50页
     ·9/8 预分频器第50-51页
     ·/B 计数器第51页
     ·三线接口第51-52页
     ·输入缓存器和输出驱动器第52页
   ·电荷泵第52-55页
   ·鉴相鉴频器第55-56页
   ·自调谐电路第56-58页
   ·带隙基准第58-59页
   ·环路滤波器第59-60页
   ·测试结果第60-71页
     ·版图和测试板第60-62页
     ·VCO 测试结果第62-64页
     ·分频器测试结果第64-66页
     ·整体测试结果第66-71页
   ·小结第71-72页
第5章 一个应用于IEEE 802.11A/B/G WLAN 的分数频率综合器第72-93页
   ·自调谐的基本问题第72-76页
     ·自调谐的定义第72-73页
     ·自调谐的必要性第73-74页
     ·常用频段选择技术第74-75页
     ·传统的自调谐电路第75-76页
   ·建议的系统结构第76-78页
     ·基本结构第76-77页
     ·频率锁定辅助结构第77-78页
   ·线性模型第78-79页
   ·电路模块第79-87页
     ·VCO第79-80页
     ·预分频器第80-81页
     ·数字鉴相鉴频器第81-82页
     ·数模转换器第82页
     ·ΣΔ调制器第82-87页
   ·测试结果第87-92页
     ·版图和测试板第87-88页
     ·VCO 测试结果第88-89页
     ·预分频器测试结果第89-90页
     ·整体测试结果第90-92页
   ·小结第92-93页
第6章 杂散减少技术和BUFFER 相位校正方案第93-107页
   ·杂散减少技术第93-99页
     ·基本原理第93-94页
     ·传统方案第94-95页
     ·改进方案第95-97页
     ·仿真验证第97-99页
   ·BUFFER 相位校正方案第99-106页
     ·系统结构第99-100页
     ·QPD第100-101页
     ·控制器第101-102页
     ·VDB第102-103页
     ·仿真结果第103-104页
     ·部分版图和测试结果第104-106页
   ·小结第106-107页
第7章 结论第107-109页
参考文献第109-118页
致谢第118-119页
个人简历和在学期间发表的学术论文第119-120页

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