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基于CMMB-STiMi标准的LDPC编译码器的设计与实现

摘要第1-5页
ABSTRACT第5-13页
第一章 引言第13-27页
   ·数字通信系统的结构第13-15页
   ·信道编码技术的发展史第15-18页
   ·信道编码及相关概念第18-20页
   ·线性分组码的基本原理第20-23页
     ·线性分组码的概念第20页
     ·生成矩阵和校验矩阵第20-22页
     ·循环码和准循环码第22-23页
   ·LDPC码的发展历史及研究现状第23-24页
   ·论文涉及项目背景与论文主要研究内容介绍第24-27页
     ·论文涉及项目背景第24-26页
     ·论文价值及内容安排第26-27页
第二章 LDPC编译码原理第27-38页
   ·LDPC码描述和图模型表达第27-28页
   ·LDPC码的环及基本LDPC码构造原则第28-29页
   ·LDPC码编码第29-30页
   ·LDPC码译码第30-33页
     ·基于tanh规则的LLR-BP译码第31-32页
     ·BP-Based 译码第32页
     ·归一化BP-based译码第32-33页
   ·LDPC译码器硬件结构分析及业界成果第33-38页
     ·译码器的基本结构第33-37页
       ·完全并行译码器第33-34页
       ·串行译码器第34-35页
       ·部分并行译码器第35-37页
     ·目前业界LDPC译码器研究及实现成果第37-38页
第三章 基于CMMB-STiMi标准的LDPC译码器硬件结构设计第38-68页
   ·CMMB-STiMi标准综述第38-39页
   ·CMMB-STiMi标准LDPC码第39-40页
   ·CMMB-STiMi标准中的LDPC码校验矩阵规则第40-41页
   ·基于CMMB-STiMi标准的LDPC译码器参数设置第41-43页
   ·基于CMMB-STiMi标准的LDPC译码器结构设计第43-63页
     ·LDPC译码器结构框图及介绍第43-44页
     ·信息节点及校验节点存储模块第44-57页
       ·信息节点和校验节点特殊存储规则第44-56页
       ·存储模块组成第56-57页
     ·校验节点更新计算模块第57-62页
       ·“基于指针”的求最小值次小值方法第57-61页
       ·校验节点更新计算模块组成第61-62页
     ·信息节点更新计算模块第62-63页
   ·基于CMMB-STiMi标准的LDPC译码器FPGA硬件实现第63-68页
     ·FPGA设计流程第63-64页
     ·LDPC译码器FPGA硬件实现情况第64-68页
       ·系统时钟第64页
       ·系统数据吞吐量第64-65页
       ·硬件资源占用情况第65-68页
第四章 基于CMMB-STiMi标准的LDPC编码器硬件结构设计第68-75页
   ·CMMB-STiMi标准的LDPC编码第68页
   ·基于CMMB-STiMi标准的LDPC编码器FPGA硬件实现第68-75页
     ·LDPC编码器硬件开发平台(Mother board)及应用简介第68-70页
     ·LDPC编码器FPGA实现设计第70-75页
       ·LDPC编码器设计思路及结构框图第70-72页
       ·数据吞吐率第72-73页
       ·硬件资源占用情况第73-75页
第五章 基于CMMB-STiMi标准的LDPC编译码器性能测试第75-84页
   ·基于CMMB-STiMi标准的LDPC译码器性能仿真及验证第75-83页
     ·验证方案第75-80页
       ·方案一硬件开发平台集成电路板GMAP简介第75-77页
       ·方案一的LDPC译码器硬件实现与验证架构第77-78页
       ·方案二的LDPC译码器硬件实现与验证架构第78-80页
     ·LDPC译码器FPGA实现功能仿真第80页
     ·调试及验证结果分析第80-83页
   ·基于CMMB-STiMi标准的LDPC编码器性能仿真及验证第83-84页
第六章 结论第84-85页
   ·基于 CMMB-STiMi 标准的 LDPC 编译码器设计成果第84页
   ·未来工作第84-85页
致谢第85-86页
参考文献第86-88页
个人简历、攻硕期间取得的研究成果第88-89页

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