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12bit 100MHz Pipeline ADC/采样/保持电路设计

摘要第5-6页
Abstract第6页
插图索引第9-11页
附表索引第11-12页
第1章 引言第12-15页
    1.1 研究背景及意义第12-13页
    1.2 发展现状及趋势第13-14页
    1.3 论文结构和主要内容第14-15页
第2章 原理分析及指标提出第15-22页
    2.1 原理及基本指标简介第15-17页
        2.1.1 原理简介第15页
        2.1.2 基本指标简介第15-17页
    2.2 误差分析第17-21页
        2.2.1 热噪声误差第18页
        2.2.2 开关引入误差第18-20页
        2.2.3 运算放大器引入误差第20-21页
    2.3 本章小结第21-22页
第3章 采样保持电路设计第22-48页
    3.1 采样保持电路选型第22-25页
    3.2 栅压自举开关设计第25-31页
        3.2.1 采样开关基本概念第25页
        3.2.2 栅压自举开关电路和原理第25-28页
        3.2.3 采样精度问题第28-31页
    3.3 运算放大器设计第31-46页
        3.3.1 典型CMOS全差分运算放大器结构第31-36页
        3.3.2 COMS全差分增益自举套筒式两级运放设计第36-46页
        3.3.3 实际设计电路原理图第46页
    3.4 本章小结第46-48页
第4章 电路仿真第48-55页
    4.1 栅压自举开关仿真第48-49页
        4.1.1 输入与栅极电压图第48页
        4.1.2 输入与输出波形图第48-49页
    4.2 全差分运算放大器仿真第49-52页
        4.2.1 开环增益/单位增益带宽/相位裕度仿真第49-50页
        4.2.2 转换速率与建立时间仿真第50-51页
        4.2.3 共模反馈电路第51-52页
    4.3 采样保持电路整体仿真第52-54页
        4.3.1 输入输出特性仿真第52-53页
        4.3.2 输出SFDR频谱图仿真第53-54页
    4.4 本章小结第54-55页
第5章 版图设计第55-61页
    5.1 版图设计基本原则第55-58页
        5.1.1 电阻电容版图第55-56页
        5.1.2 匹配对称性版图第56页
        5.1.3 隔离与屏蔽第56-58页
        5.1.4 布线第58页
    5.2 关键电路的版图实现第58-60页
        5.2.1 采样/保持电路电容版图第58-59页
        5.2.2 栅压自举开关版图第59页
        5.2.3 全差分运算放大器版图第59-60页
        5.2.4 采样/保持电路整体版图第60页
    5.3 本章小结第60-61页
总结与展望第61-62页
参考文献第62-64页
致谢第64页

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