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H.264/AVC视频解码器的设计及其SoC实现

摘要第1-7页
Abstract第7-11页
第一章 集成电路与数字多媒体处理的发展第11-18页
   ·当今集成电路的发展概述第11-14页
     ·SoC设计和系统级设计概述第12-13页
     ·IP重用设计方法学概述第13-14页
   ·数字多媒体处理技术及其发展第14-16页
     ·数字视频及其应用第14-15页
     ·数字视频数据压缩的可能性第15-16页
     ·数字视频压缩技术的主要原理第16页
   ·本文的结构及本人完成的工作第16-18页
第二章 H.264/AVC视频压缩标准的基本原理第18-28页
   ·H.264编码算法的历史和特点第18-20页
   ·H.264算法的特点第20-21页
   ·TS流的传输以及解析过程第21-24页
   ·H.264编解码原理介绍第24-27页
   ·本章小结第27-28页
第三章 SoC芯片架构设计第28-37页
   ·H.264全解码芯片的设计目标第28页
   ·H.264视频解码系统概述及实现方式选择第28-31页
   ·H.264芯片设计流程及验证方式第31-35页
     ·模块设计和RTL实现第32-33页
     ·模块的功能验证第33-34页
     ·模块综合第34页
     ·FPGA原型技术的应用第34-35页
   ·本章小结第35-37页
第四章 码流处理硬件模块的设计和实现第37-53页
   ·码流头转换模块设计第37-40页
   ·码流头转换模块功能实现方式第40-46页
     ·码流处理部分的原理第40-41页
     ·码流处理部分的实现方法第41-43页
       ·NAL头的检测并滤除第41-42页
       ·防止竞争字节的检测并滤除第42-43页
       ·字节补齐的若干”0x00”的检测并滤除第43页
     ·NAL边界检测步骤的处理过程第43-45页
     ·NAL边界检测步骤的实现方法第45-46页
     ·码流头转换模块的时钟和硬件资源第46页
   ·Input Buffer Controller模块设计实现第46-52页
     ·Input Buffer Controller的设计基本原理第46-47页
     ·Input Buffer Controller模块设计第47-51页
       ·三个熵解码请求的特点和处理方式第47-48页
       ·Input Buffer Controller内部buffer的设计第48-49页
       ·Input Buffer Controller内部buffer的读写控制第49-50页
       ·slice边界信息的取得第50页
       ·slice边界检测及后续处理过程第50-51页
     ·Input Buffer Controller模块时钟和硬件资源第51-52页
   ·本章小结第52-53页
第五章 去块效应预处理模块的设计和实现第53-69页
   ·去块效应预处理模块功能介绍第53-56页
   ·去块效应预处理模块结构设计第56-68页
     ·去块效应预处理模块的硬件结构分析第56-57页
     ·片内SRAM结构和组织方式第57-61页
     ·Data_controller模块设计第61-65页
       ·Data_controller的控制逻辑第61-63页
       ·Data_controller的时钟策略第63-65页
       ·Data_controller的电路组织第65页
     ·本模块和熵解码模块之间数据处理顺序的差别和解决方法第65-67页
     ·其他数据处理模块的设计第67-68页
   ·本章小结第68-69页
第六章 设计验证和实现结果第69-72页
   ·设计验证第69-71页
     ·参考软件模型的修改第69-70页
     ·仿真过程的自动化第70页
     ·仿真工具使用和仿真模块的通用性第70-71页
   ·项目实现结果第71页
     ·本人负责的个模块的实现结果第71页
     ·系统的实现结果第71页
   ·本章小结第71-72页
第七章 总结与展望第72-73页
致谢第73-74页
参考文献第74-76页
个人简历 在读期间发表的学术论文与研究成果第76页

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