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可迭代译码纠错码的译码算法和硬件实现技术的研究

摘要第1-5页
ABSTRACT第5-12页
第一章 绪论第12-16页
   ·数字通信系统的基本结构第12-13页
   ·信道编码概述第13-15页
     ·LDPC 码的特点及研究情况第13-14页
     ·Turbo 码的特点及研究情况第14-15页
   ·本文的主要工作及内容安排第15-16页
第二章 LDPC 码基本原理第16-28页
   ·LDPC 码的定义及表示方法第16-18页
     ·LDPC 码的校验矩阵表示法第16-17页
     ·LDPC 码的Tanner 图表示法第17-18页
   ·LDPC 码的编码第18-20页
     ·高斯消元法第18-19页
     ·基于近似下三角矩阵的有效编码第19-20页
   ·LDPC 码的BP 译码算法第20-24页
   ·LDPC 码BP 算法的性能模拟第24-27页
   ·小结第27-28页
第三章 LDPC 码的简化编/译码算法第28-36页
   ·基于生成矩阵的非正规LDPC 码第28-32页
     ·基于生成矩阵的非正规LDPC 码的编码第28-29页
     ·基于生成矩阵的非正规LDPC 码的BP 译码算法第29-30页
     ·基于生成矩阵的非正规LDPC 码的性能模拟第30-32页
   ·LDPC 码译码算法的简化第32-35页
     ·Log_BP 译码算法第32-33页
     ·BP_Based 译码算法第33页
     ·简化译码算法的性能仿真第33-35页
   ·小结第35-36页
第四章 Turbo 码基本原理第36-47页
   ·Turbo 码编码基本原理第36-37页
   ·Turbo 码的迭代译码算法第37-43页
     ·Turbo 码译码器结构第37页
     ·MAP 算法第37-41页
     ·改进的MAP 算法第41-42页
     ·SOVA 算法第42-43页
   ·Turbo 码译码性能仿真分析第43-46页
   ·小结第46-47页
第五章 Turbo 码交织器研究第47-53页
   ·对称交织器第47-48页
   ·归零交织器第48页
   ·归零奇偶对称交织器的构造方法第48-49页
   ·仿真结果与分析第49-52页
   ·小结第52-53页
第六章 Turbo 码的可实现译码结构第53-62页
   ·Turbo 码的并行译码结构第53-58页
     ·并行译码结构基本原理第53-54页
     ·并行译法结构中交织器的设计第54-58页
   ·Turbo 码的串行译码结构第58-61页
     ·串行译码结构基本原理第58-59页
     ·基于MAX_Log_MAP 算法的优化算法第59-61页
     ·改进算法仿真分析第61页
   ·小结第61-62页
第七章 Turbo 码的编/译码器实现第62-75页
   ·FPGA 设计概述第62-65页
     ·FPGA 设计的流程第62-64页
     ·FPGA 的设计工具第64-65页
     ·硬件描述语言的选择第65页
   ·系统参数的选取第65-67页
     ·分量编码器第65页
     ·交织器第65-66页
     ·码率第66页
     ·迭代次数第66页
     ·量化位数第66-67页
   ·Turbo 码编/译码器的FPGA 实现第67-74页
     ·Turbo 码交织器实现第67-68页
     ·Turbo 码编码器实现第68-69页
     ·Turbo 码译码器实现第69-73页
     ·Turbo 码编/译码器性能分析及资源消耗第73-74页
   ·小结第74-75页
第八章 迭代译码算法分析第75-82页
   ·Turbo 码和LDPC 码的编/译码性能比较第75-77页
     ·编码性能比较第75-76页
     ·译码性能比较第76-77页
     ·Turbo 码和LDPC 码性能比较总结第77页
   ·Turbo 码和LDPC 码译码算法之间的联系第77-81页
     ·LDPC 码的turbo 码译码算法第77-80页
     ·Turbo 码和LDPC 码的级联第80-81页
   ·小结第81-82页
第九章 本文总结第82-83页
参考文献第83-86页
致谢第86-87页
攻读硕士学位期间发表的学术论文第87页

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