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适用于多协议的高速均衡器研究及自适应算法的实现

摘要第4-5页
Abstract第5页
第1章 绪论第9-13页
    1.1 课题研究背景第9-10页
    1.2 国内外研究现状第10-11页
    1.3 论文的主要内容及结构安排第11-13页
第2章 高速串行通信原理第13-25页
    2.1 概述第13页
    2.2 信道的非理想性第13-15页
        2.2.1 高频损耗第13-14页
        2.2.2 反射第14页
        2.2.3 串扰第14-15页
    2.3 均衡器第15-21页
        2.3.1 均衡原理第15-16页
        2.3.2 均衡器分类第16-21页
            2.3.2.1 线性均衡器第16-18页
            2.3.2.2 非线性均衡第18页
            2.3.2.3 组合均衡第18-19页
            2.3.2.4 自适应均衡第19-21页
    2.4 多协议通信第21-25页
        2.4.1 高速多协议信道举例第21-22页
            2.4.1.1 PCIe3协议信道第21-22页
            2.4.1.2 10GBase-KR协议信道第22页
        2.4.2 多协议均衡技术第22-25页
第3章 适用于多协议的自适应均衡器的建模第25-35页
    3.1 概述第25页
    3.2 多协议信道的建模第25-26页
    3.3 多协议链路均衡器设计考虑第26-27页
    3.4 多协议链路均衡器建模第27-29页
        3.4.1 建模整体结构设计第27页
        3.4.2 基于ADS的建模第27-29页
    3.5 SS-LMS算法与EOM第29-32页
        3.5.1 SS-LMS算法第29页
        3.5.2 基于EOM的SS-LMS算法第29-32页
            3.5.2.1 矩形掩模EOM第29-30页
            3.5.2.2 基于EOM的误差采集模块第30-31页
            3.5.2.3 基于EOM的SS-LMS算法推导第31-32页
    3.6 建模仿真第32-35页
第4章 基于EOM的多协议自适应均衡器设计第35-55页
    4.1 概述第35页
    4.2 多协议自适应均衡器整体结构第35页
    4.3 FFE设计第35-43页
        4.3.1 延时线第36-39页
            4.3.1.1 电感峰化第36-38页
            4.3.1.2 源极电容衰减技术第38-39页
        4.3.2 抗频率和工艺角变化设计第39-41页
        4.3.3 CML加法器第41-43页
    4.4 半速率DFE第43-45页
        4.4.1 主从D触发器第43-44页
        4.4.2 2:1复用器第44-45页
    4.5 基于EOM的LMS自适应模块的设计第45-50页
        4.5.1 自适应模块整体设计第45-46页
        4.5.2 基于EOM的计数标志位生成电路第46-49页
            4.5.2.1 单差分灵敏放大器第46-48页
            4.5.2.2 双差分灵敏放大器第48-49页
        4.5.3 加/减计数器第49-50页
        4.5.4 数模转换器第50页
    4.6 多协议自适应均衡器的前仿真第50-55页
第5章 版图设计与后仿真第55-61页
    5.1 概述第55页
    5.2 版图设计流程第55页
    5.3 版图设计注意事项第55-56页
    5.4 多协议自适应均衡器的版图设计及仿真第56-58页
    5.5 芯片测试方案第58-61页
第6章 总结与展望第61-63页
    6.1 总结第61页
    6.2 展望第61-63页
参考文献第63-67页
致谢第67-69页
攻读硕士期间发表论文第69页

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